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參數(shù)資料
| 型號： | AT89LP428-20PU |
| 廠商： | Atmel |
| 文件頁數(shù)： | 79/149頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 8051 4K FLASH SPI 28PDIP |
| 產(chǎn)品培訓(xùn)模塊： | MCU Product Line Introduction |
| 標(biāo)準(zhǔn)包裝： | 14 |
| 系列： | 89LP |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 20MHz |
| 連通性： | SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 30 |
| 程序存儲(chǔ)器容量： | 4KB（4K x 8） |
| 程序存儲(chǔ)器類型： | 閃存 |
| EEPROM 大?。?/td> | 512 x 8 |
| RAM 容量： | 768 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.4 V ~ 5.5 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 28-DIP（0.300"，7.62mm） |
| 包裝： | 管件 |
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35
3654A–MICRO–8/09
AT89LP428/828
10. I/O Ports
The AT89LP428/828 can be configured for between 23 and 30 I/O pins. The exact number of
I/O pins available depends on the package type and the clock and reset options as shown in
10.1
Port Configuration
All port pins on the AT89LP428/828 may be configured to one of four modes: quasi-bidirectional
(standard 8051 port outputs), push-pull output, open-drain output, or input-only. Port modes may
be assigned in software on a pin-by-pin basis as shown in Table 10-2 using the registers listed in
Table 10-3. The Tristate-Port User Fuse determines the default state of the port pins. When the
fuse is enabled, all port pins default to input-only mode after reset. When the fuse is disabled, all
port pins, with the exception of the analog inputs, P2.4, P2.5, P2.6 and P2.7, default to quasi-
bidirectional mode after reset and are weakly pulled high. The analog input pins always reset to
input-only (tristate) mode. Each port pin also has a Schmitt-triggered input for improved input
noise rejection. During Power-down all the Schmitt-triggered inputs are disabled with the excep-
tion of P3.2 (INT0), P3.3 (INT1), P3.6 (RST), P4.0 (XTAL1) and P4.1 (XTAL2) which may be
used to wake up the device. Therefore, P3.2, P3.3, P3.6, P4.0 and P4.1 should not be left float-
ing during Power-down. In addition any pin of Port 1 configured as a GPI input will also remain
active during Power-down to wake-up the device. These interrupt pins should either be disabled
before entering Power-down or they should not be left floating.
Table 10-1.
I/O Pin Configurations
Clock Source
Reset Option
Package
Number of I/O Pins
External Crystal or
Resonator
External RST Pin
PDIP
23
TQFP or PLCC
27
No external reset
PDIP
24
TQFP or PLCC
28
External Clock
External RST Pin
PDIP
24
TQFP or PLCC
28
No external reset
PDIP
25
TQFP or PLCC
29
Internal RC Oscillator
External RST Pin
PDIP
25
TQFP or PLCC
29
No external reset
PDIP
26
TQFP or PLCC
30
Table 10-2.
Configuration Modes for Port x, Bit y
PxM0.y
PxM1.y
Port Mode
00
Quasi-bidirectional
01
Push-pull Output
10
Input Only (High Impedance)
1
Open-drain Output
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PDF描述 |
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| AT89LP51-20PU | 功能描述:8位微控制器 -MCU Single Cycle 8051 4K ISP FL RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
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