參數(shù)資料
型號： ATTINY2313V-10SUR
廠商： Atmel
文件頁數(shù)： 127/225頁
文件大?。?/td> 0K
描述： IC MCU AVR 2K FLASH 20SOIC
產(chǎn)品培訓(xùn)模塊： tinyAVR Introduction
標(biāo)準(zhǔn)包裝： 1,000
系列： AVR® ATtiny
核心處理器： AVR
芯體尺寸： 8-位
速度： 10MHz
連通性： SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 18
程序存儲器容量： 2KB（1K x 16）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 128 x 8
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-SOIC（0.295"，7.50mm 寬）
包裝： 帶卷 (TR)
其它名稱： ATTINY2313V-10SUR-ND
ATTINY2313V-10SURTR
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PIC16F72X/PIC16LF72X
DS41341E-page 212
2009 Microchip Technology Inc.
23.1
DC Characteristics: PIC16F72X/PIC16LF72X-I/E (Industrial, Extended)
PIC16LF72X
Standard Operating Conditions (unless otherwise stated)
Operating temperature
-40°C
≤ TA ≤ +85°C for industrial
-40°C
≤ TA ≤ +125°C for extended
PIC16F72X
Standard Operating Conditions (unless otherwise stated)
Operating temperature
-40°C
≤ TA ≤ +85°C for industrial
-40°C
≤ TA ≤ +125°C for extended
Param.
No.
Sym.
Characteristic
Min.
Typ
Max.
Units
Conditions
D001
VDD
Supply Voltage
PIC16LF72X
1.8
2.3
2.5
—
3.6
V
FOSC
≤ 16 MHz: HFINTOSC, EC
FOSC
≤ 4MHz
FOSC
≤ 20 MHz, EC
FOSC
≤ 20 MHz, HS
D001
PIC16F72X
1.8
2.3
2.5
—
5.5
V
FOSC
≤ 16 MHz: HFINTOSC, EC
FOSC
≤ 4 MHz
FOSC
≤ 20 MHz, EC
FOSC
≤ 20 MHz, HS
D002*
VDR
RAM Data Retention Voltage(1)
PIC16LF72X
1.5
—
V
Device in Sleep mode
D002*
PIC16F72X
1.7
—
V
Device in Sleep mode
VPOR*
Power-on Reset Release Voltage
—1.6
—
V
VPORR*
Power-on Reset Rearm Voltage
PIC16LF72X
—
0.8
—
V
Device in Sleep mode
PIC16F72X
—
1.7
—
V
Device in Sleep mode
D003
VFVR
Fixed Voltage Reference Voltage,
Initial Accuracy
-5.5
—
5.5
%
VFVR = 1.024V, VDD
≥ 2.5V
VFVR = 2.048V, VDD
≥ 2.5V
VFVR = 4.096V, VDD
≥ 4.75V;
-40
≤ TA ≤ 85°C
-6
—
6
%
VFVR = 1.024V, VDD
≥ 2.5V
VFVR = 2.048V, VDD
≥ 2.5V
VFVR = 4.096V, VDD
≥ 4.75V;
-40
≤ TA ≤ 125°C
D004*
SVDD
VDD Rise Rate to ensure internal
Power-on Reset signal
0.05
—
V/ms
(POR)” for details.
*
These parameters are characterized but not tested.
Data in “Typ” column is at 3.3V, 25°C unless otherwise stated. These parameters are for design guidance only and are
not tested.
Note 1: This is the limit to which VDD can be lowered in Sleep mode without losing RAM data.
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