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參數(shù)資料
| 型號： | ATTINY2313V-10SUR |
| 廠商： | Atmel |
| 文件頁數(shù)： | 30/225頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU AVR 2K FLASH 20SOIC |
| 產(chǎn)品培訓(xùn)模塊： | tinyAVR Introduction |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | AVR® ATtiny |
| 核心處理器： | AVR |
| 芯體尺寸： | 8-位 |
| 速度： | 10MHz |
| 連通性： | SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 18 |
| 程序存儲器容量： | 2KB（1K x 16） |
| 程序存儲器類型： | 閃存 |
| EEPROM 大?。?/td> | 128 x 8 |
| RAM 容量： | 128 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 20-SOIC（0.295"，7.50mm 寬） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | ATTINY2313V-10SUR-ND ATTINY2313V-10SURTR |
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2009 Microchip Technology Inc.
DS41341E-page 125
PIC16F72X/PIC16LF72X
12.12 Timer1 Gate Control Register
The Timer1 Gate Control register (T1GCON), shown in
Register 12-2, is used to control Timer1 Gate.
REGISTER 12-2:
T1GCON: TIMER1 GATE CONTROL REGISTER
R/W-0
R-x
R/W-0
TMR1GE
T1GPOL
T1GTM
T1GSPM
T1GGO/
DONE
T1GVAL
T1GSS1
T1GSS0
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 7
TMR1GE: Timer1 Gate Enable bit
If TMR1ON = 0:
This bit is ignored
If TMR1ON = 1:
1
= Timer1 counting is controlled by the Timer1 gate function
0
= Timer1 counts regardless of Timer1 gate function
bit 6
T1GPOL: Timer1 Gate Polarity bit
1
= Timer1 gate is active-high (Timer1 counts when gate is high)
0
= Timer1 gate is active-low (Timer1 counts when gate is low)
bit 5
T1GTM: Timer1 Gate Toggle Mode bit
1
= Timer1 Gate Toggle mode is enabled.
0
= Timer1 Gate Toggle mode is disabled and toggle flip flop is cleared
Timer1 gate flip flop toggles on every rising edge.
bit 4
T1GSPM: Timer1 Gate Single Pulse Mode bit
1
= Timer1 gate Single-Pulse mode is enabled and is controlling Timer1 gate
0
= Timer1 gate Single-Pulse mode is disabled
bit 3
T1GGO/DONE: Timer1 Gate Single-Pulse Acquisition Status bit
1
= Timer1 gate single-pulse acquisition is ready, waiting for an edge
0
= Timer1 gate single-pulse acquisition has completed or has not been started
This bit is automatically cleared when T1GSPM is cleared.
bit 2
T1GVAL: Timer1 Gate Current State bit
Indicates the current state of the Timer1 gate that could be provided to TMR1H:TMR1L.
Unaffected by Timer1 Gate Enable (TMR1GE).
bit 1-0
T1GSS<1:0>: Timer1 Gate Source Select bits
00
= Timer1 Gate pin
01
= Timer0 Overflow output
10
= TMR2 Match PR2 output
11
= Watchdog Timer scaler overflow
Watchdog Timer oscillator is turned on if TMR1GE = 1, regardless of the state of TMR1ON
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