參數(shù)資料
型號： CDB5346
廠商： Cirrus Logic Inc
文件頁數(shù)： 24/38頁
文件大小： 0K
描述： BOARD EVAL FOR CS5346
標(biāo)準(zhǔn)包裝： 1
ADC 的數(shù)量： 2
位數(shù)： 24
采樣率（每秒）： 192k
數(shù)據(jù)接口： 串行
輸入范圍： 3.15 Vpp
在以下條件下的電源（標(biāo)準(zhǔn)）： 205mW @ 192kSPS
工作溫度： -40°C ~ 85°C
已用 IC / 零件： CS5346
已供物品： 板，纜線，CD
產(chǎn)品目錄頁面： 756 (CN2011-ZH PDF)
相關(guān)產(chǎn)品： CS5346-CQZR-ND - IC ADC AUD 103DB 200KHZ 48-LQFP
598-1692-ND - IC ADC AUD 103DB 200KHZ 48LQFP
其它名稱： 598-1790
30
DS861PP3
CS5346
7.4
MCLK Frequency - Address 05h
7.4.1
Master Clock Dividers (Bits 6:4)
Function:
Sets the frequency of the supplied MCLK signal. See Table 8 for the appropriate settings.
7.5
PGAOut Control - Address 06h
7.5.1
PGAOut Source Select (Bit 6)
Function:
This bit is used to configure the PGAOut pins to be either high impedance or PGA outputs. Refer to
7.6
Channel B PGA Control - Address 07h
7.6.1
Channel B PGA Gain (Bits 5:0)
Function:
76
543
21
0
Reserved
MCLK
Freq2
MCLK
Freq1
MCLK
Freq0
Reserved
MCLK Divider
MCLK Freq2 MCLK Freq1 MCLK Freq0
÷1
000
÷1.5
001
÷2
010
÷3
011
÷4
100
Reserved
101
Reserved
11
x
Table 8. MCLK Frequency
76
543
21
0
Reserved
PGAOut
Reserved
PGAOut
PGAOutA & PGAOutB
0
High Impedance
1
PGA Output
Table 9. PGAOut Source Selection
76
543
21
0
Reserved
Gain5
Gain4
Gain3
Gain2
Gain1
Gain0
相關(guān)PDF資料
PDF描述
CDB5345 EVALUATION BOARD FOR CS5345
ASM06DSEN-S243 CONN EDGECARD 12POS .156 EYELET
ASM06DSEH-S243 CONN EDGECARD 12POS .156 EYELET
MLG1005S82NJ INDUCTOR MULTILAYER 82NH 0402
CDB5341 BOARD EVAL FOR CS5341 STEREO ADC
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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CDB5360 制造商:CIRRUS 制造商全稱:Cirrus Logic 功能描述:Evaluation Board
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