VCC = 5.0V ±10%, T
參數(shù)資料
型號： CP82C50A-5Z
廠商： Intersil
文件頁數(shù)： 10/25頁
文件大?。?/td> 0K
描述： IC ASYNC COMM ELEMENT UART 40DIP
標準包裝： 9
特點： 單芯片 UART/BRG
通道數(shù)： 1，UART
規(guī)程： RS232C
電源電壓： 4.5 V ~ 5.5 V
帶并行端口： 是
帶故障啟動位檢測功能： 是
帶調(diào)制解調(diào)器控制功能： 是
帶CMOS： 是
安裝類型： 通孔
封裝/外殼： 40-DIP（0.600"，15.24mm）
供應(yīng)商設(shè)備封裝： 40-DIP
包裝： 管件
18
FN2958.5
August 24, 2006
82C50A
AC Electrical Specifications
VCC = 5.0V ±10%, TA = 0
oC to +70oC (CX82C50A-5) T
A = -40
oC to +85oC (lX82C50A-5)
Timing Requirements
SYMBOL
PARAMETER
82C50A-5
TEST CONDITIONS
MIN
MAX
UNITS
(1)
TAW
Address Strobe Width
50
-
ns
(2)
TAS
Address Setup Time
60
-
ns
Note 1
(3)
TAH
Address Hold Time
0
-
ns
(4)
TCS
Chip Select Setup Time
60
-
ns
Note 1
(5)
TCH
Chip Select Hold Time
0
-
ns
(6)
TDIW
DISTR DlSTR Strobe Width
150
-
ns
(7)
TRC
Read Cycle Delay
270
-
ns
Note 1
(8)
RC
Read Cycle = TAR + TDIW + TRC
500
-
ns
(9)
TDD
DISTR DlSTR to Driver Disable Delay
-
75
ns
(10)
TDDD
Delay From DISTR DlSTR to Data
-
120
ns
(11)
THZ
DlSTR DISTR to Floating Data Delay
10
75
ns
(12)
TDOW
DOSTR DOSTR Strobe Width
150
-
ns
(13)
TWC
Write Cycle Delay
270
-
ns
Note 1
(14)
WC
Write Cycle = TAW + TDOW + TWC
500
-
ns
(15)
TDS
Data Setup Time
90
-
ns
(16)
TDH
Data Hold Time
60
-
ns
NOTE:
1. “When using the 82C50A in the multiplexed mode (ADS operational), it will operate in 80C86/88 systems with a maximum 3MHz operating
frequency.”
AC Electrical Specifications
VCC = 5.0V ±10%, TA = 0
oC to +70oC (CX82C50A-5) T
A = -40
oC to +85oC (lX82C50A-5)
Timing
SYMBOL
PARAMETER
82C50A-5
UNITS
TEST CONDITIONS
MIN
MAX
DEMULTIPLEXED OPERATION
(17)
TCSC
Chip Select Output Delay from Select
-
125
ns
(18)
TRA
Address Hold Time from DISTR DISTR
20
-
ns
(19)
TRCS
Chip Select Hold Time from DISTR DISTR
20
-
ns
(20)
TAR
DISTR DISTR Delay from Address
80
-
ns
(21)
TCSR
DISTR DISTR Delay from Chip Select
80
-
ns
(22)
TWA
Address Hold Time from DOSTR DOSTR
20
-
ns
(23)
TWCS
Chip Select Hold Time from DOSTR DOSTR
20
-
ns
(24)
TAW
DOSTR DOSTR Delay from Address
80
-
ns
(25)
TCSW
DOSTR DOSTR Delay from Select
80
-
ns
(26)
TMRW
Master Reset Pulse Width
500
-
ns
(27)
TXH
Duration of Clock High Pulse
40
-
ns
(28)
TXL
Duration of Clock Low Pulse
40
ns
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PDF描述
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