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參數(shù)資料
| 型號： | CYWUSB6935 |
| 廠商： | Cypress Semiconductor Corp. |
| 英文描述： | WirelessUSB LR 2.4-GHz DSSS Radio SoC(WirelessUSB LR 2.4-GHz DSSS無線SoC) |
| 中文描述： | 的WirelessUSB LR 2.4 GHz的無線擴(kuò)頻系統(tǒng)芯片（的WirelessUSB LR 2.4 GHz的無線擴(kuò)頻芯片） |
| 文件頁數(shù)： | 7/32頁 |
| 文件大?。?/td> | 395K |
| 代理商： | CYWUSB6935 |
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CYWUSB6935
Document #: 38-16008 Rev. *D
Page 7 of 32
7.0
Register Descriptions
Table 7-1
displays the list of registers inside the
CYWUSB6935 that are addressable through the SPI interface.
All registers are read and writable, except where noted.
Note:
1.
All registers are accessed Little Endian.
Table 7-1. CYWUSB6935 Register Map
[1]
Register Name
Mnemonic
CYWUSB6935
Address
0x00
0x03
0x04
0x05
0x06
0x07
0x08
0x09
0x0A
0x0B
0x0C
0x0D
0x0E
0x0F
0x10
0x18–0x11
0x19
0x1A
0x1C
0x1D
0x20
0x21
0x22
0x23
0x24
0x26
0x2E
0x2F
0x32
0x33
0x38
0x3C–0x3F
Page
8
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9
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10
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17
18
18
18
19
19
19
19
19
20
20
Default
0x07
0x00
0x00
0x01
0x03
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
Access
RO
RW
RW
RW
RW
RW
RO
RO
RO
RO
RO
RW
RO
RW
RW
RW
RW
RW
RW
RO
RW
RW
RO
RW
RW
RW
RW
RW
RW
RW
RW
RO
Revision ID
Control
Data Rate
Configuration
SERDES Control
Receive SERDES Interrupt Enable REG_RX_INT_EN
Receive SERDES Interrupt Status
Receive SERDES Data A
Receive SERDES Valid A
Receive SERDES Data B
Receive SERDES Valid B
Transmit SERDES Interrupt Enable REG_TX_INT_EN
Transmit SERDES Interrupt Status
Transmit SERDES Data
Transmit SERDES Valid
PN Code
Threshold Low
Threshold High
Wake Enable
Wake Status
Analog Control
Channel
Receive Signal Strength Indicator
PA Bias
Crystal Adjust
VCO Calibration
Reg Power Control
Carrier Detect
Clock Manual
Clock Enable
Synthesizer Lock Count
Manufacturing ID
REG_ID
REG_CONTROL
REG_DATA_RATE
REG_CONFIG
REG_SERDES_CTL
REG_RX_INT_STAT
REG_RX_DATA_A
REG_RX_VALID_A
REG_RX_DATA_B
REG_RX_VALID_B
REG_TX_INT_STAT
REG_TX_DATA
REG_TX_VALID
REG_PN_CODE
REG_THRESHOLD_L
REG_THRESHOLD_H
REG_WAKE_EN
REG_WAKE_STAT
REG_ANALOG_CTL
REG_CHANNEL
REG_RSSI
REG_PA
REG_CRYSTAL_ADJ
REG_VCO_CAL
REG_PWR_CTL
REG_CARRIER_DETECT
REG_CLOCK_MANUAL
REG_CLOCK_ENABLE
REG_SYN_LOCK_CNT
REG_MID
0x1E8B6A3DE0E9B222
0x08
0x38
0x00
0x01
0x04
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x64
–
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