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參數(shù)資料
| 型號： | DAC3550A |
| 廠商： | MICRONAS SEMICONDUCTOR HOLDING AG |
| 元件分類： | DAC |
| 英文描述： | ECONOLINE: RSZ/P - 1kVDC |
| 中文描述： | 32-BIT DAC, PQFP44 |
| 封裝： | METRIC, PLASTIC, QFP-44 |
| 文件頁數(shù)： | 27/35頁 |
| 文件大小： | 626K |
| 代理商： | DAC3550A |
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DAC 3550A
Micronas
27
4.5. Power-up/down Sequence
In order to get a click-free power-up/down characteris-
tic, it is recommended to use the following sequences:
4.5.1. Power-up Sequence
1. Start VDD from 0 to +3.3 V and start AVDD0/1 from
0 to +3.3 V/+5 V. AVDD should not ramp up faster
than VDD.
2. Release PORQ from 0 to AVDD0/1.
3. Send I2C: volume, input select, speaker, ... optional.
4. Start I2S data.
The most important point is: PORQ has to ramp up
after AVDD0/1, simply by using a 10-k
pull-up resis-
tor to AVDD0/1 and a 2.2-nF capacitor to ground. No
further control on PORQ is needed.
Fig. 4
–
7:
Power-up sequence
4.5.2. Power-down Sequence
1. Stop I2S data.
2. Send I2C: LOW POWER.
3. Switch VDD, AVDD0/1 to 0.
VDD
AVDD
PORQ
≥
90% VDD
≥
90% AVDD
<0.2
×
VDD
<30 ms
0.7
×
AVDD
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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