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參數(shù)資料
| 型號(hào)： | DPL4519G |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Sound Processor for Digital and Analog Surround Systems |
| 中文描述： | 聲音處理器的數(shù)字和模擬環(huán)繞聲系統(tǒng) |
| 文件頁數(shù)： | 54/64頁 |
| 文件大?。?/td> | 1073K |
| 代理商： | DPL4519G |
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DPL 4519G
PRELIMINARY DATA SHEET
54
Micronas
4.6.3.5. I
2
S-Bus Characteristics
Symbol
Parameter
Pin Name
Min.
Typ.
Max.
Unit
Test Conditions
V
I2SIL
Input Low Voltage
I2S_CL
I2S_WS
I2S_CL3
I2S_WS3
I2S_DA_IN1..3
0.2
V
SUP2
V
I2SIH
Input High Voltage
0.5
V
SUP2
Z
I2SI
Input Impedance
5
pF
I
LEAKI2S
Input Leakage Current
1
1
μ
A
0 V < U
INPUT
< DVSUP
V
I2SOL
I
2
S Output Low Voltage
I2S_CL
I2S_WS
I2S_DA_OUT
0.4
V
I
I2SOL
= 1 mA
V
I2SOH
I
2
S Output High Voltage
V
0.3
V
I
I2SOH
=
1 mA
f
I2SOWS
I
2
S-Word Strobe Output Frequency
I2S_WS
48.0
kHz
f
I2SOCL
I
2
S-Clock Output Frequency
I2S_CL
1.536
3.072
12.288
MHz
R
I2S10/I2S20
I
2
S-Clock Output High/Low-Ratio
0.9
1.0
1.1
Synchronous I
2
S Interface
t
s_I2S
I
2
S Input Setup Time
before Rising Edge of Clock
I2S_DA_IN1/2
I2S_CL
12
ns
for details see Fig. 4–21
“I
2
S timing diagram (syn-
chronous interface)”
t
h_I2S
I
2
S Input Hold Time
after Rising Edge of Clock
40
ns
t
d_I2S
I
2
S Output Delay Time
after Falling Edge of Clock
I2S_CL
I2S_WS
I2S_DA_OUT
28
ns
C
L
=30 pF
f
I2SWS
I
2
S-Word Strobe Input Frequency
I2S_WS
48.0
kHz
f
I2SCL
I
2
S-Clock Input Frequency
I2S_CL
1.536
3.072
12.288
MHz
R
I2SCL
I
2
S-Clock Input Ratio
0.9
1.1
Asynchronous I
2
S Interface
t
s_I2S3
I
2
S3 Input Setup Time
before Rising Edge of Clock
I2S_CL3
I2S_WS3
I2S_DA_IN3
4
ns
for details see Fig. 4–22
“I
2
S timing diagram (asyn-
chronous interface)”
t
h_I2S3
I
2
S3 Input Hold Time
after Rising Edge of Clock
40
ns
f
I2S3WS
I
2
S3-Word Strobe Input Frequency
I2S_WS3
5
50
kHz
f
I2S3CL
I
2
S3-Clock Input Frequency
I2S_CL3
3.2
MHz
R
I2S3CL
I
2
S3-Clock Input Ratio
0.9
1.1
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