參數(shù)資料
型號(hào)： DS21352LB
廠商： Maxim Integrated Products
文件頁數(shù)： 21/137頁
文件大?。?/td> 0K
描述： IC TXRX 1-CHIP T1 3.3V 100-LQFP
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
產(chǎn)品變化通告： Product Discontinuation 20/Feb/2012
標(biāo)準(zhǔn)包裝： 90
功能： 單芯片收發(fā)器
接口： HDLC，T1
電路數(shù)： 1
電源電壓： 3.14 V ~ 3.47 V
電流 - 電源： 75mA
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應(yīng)商設(shè)備封裝： 100-LQFP（14x14）
包裝： 托盤
包括： DSX-1 和 CSU 線路補(bǔ)償發(fā)生器，HDLC 控制器，帶內(nèi)回路代碼發(fā)生器和檢測(cè)器
DS21352/DS21552
117 of 137
Figure 21-10 TRANSMIT SIDE BOUNDARY TIMING (with elastic store
disabled)
Notes:
1. TSYNC is in the output mode (TCR2.2 = 1)
2. TSYNC is in the input mode (TCR2.2 = 0)
3. TCHBLK is programmed to block channel 2
4. Shown is TLINK/TLCLK in the ESF framing mode
Figure 21-11 TRANSMIT SIDE 1.544 MHz BOUNDARY TIMING (with elastic
store enabled)
Notes:
1. TCHBLK is programmed to block channel 24 (if the TPCSI bit is set, then the signaling data at TSIG will be ignored during
channel 24).
LSB
F
MSB
LSB MSB
CHANNEL 1
CHANNEL 2
CHANNEL 1
CHANNEL 2
AB
C/A
D/B
AB
C/A
D/B
TCLK
TSER
TSYNC
TSIG
TCHCLK
TCHBLK
TLCLK
TLINK
D/B
1
2
3
4
DON'T CARE
LSB
F MSB
LSB MSB
CHANNEL 1
CHANNEL 24
A
B
C/A D/B
A
B
C/A D/B
TSYSCLK
TSER
TSSYNC
TSIG
TCHCLK
TCHBLK
CHANNEL 23
A
CHANNEL 23
CHANNEL 24
CHANNEL 1
1
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PDF描述
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