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參數(shù)資料
| 型號(hào)： | DS21552LN |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 36/137頁 |
| 文件大小： | 0K |
| 描述： | IC TXRX T1 1-CHIP 5V 100-LQFP |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS |
| 產(chǎn)品變化通告： | Product Discontinuation 20/Feb/2012 |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 功能： | 單芯片收發(fā)器 |
| 接口： | E1，HDLC，J1，T1 |
| 電路數(shù)： | 1 |
| 電源電壓： | 4.75 V ~ 5.25 V |
| 電流 - 電源： | 75mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應(yīng)商設(shè)備封裝： | 100-LQFP（14x14） |
| 包裝： | 托盤 |
| 包括： | DSX-1 和 CSU 線路補(bǔ)償發(fā)生器，HDLC 控制器，帶內(nèi)回路代碼發(fā)生器和檢測(cè)器 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁當(dāng)前第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁
DS21352/DS21552
130 of 137
24.3 RECEIVE SIDE AC CHARACTERISTICS
AC CHARACTERISTICS –
RECEIVE SIDE
[See Figure 24-8 to Figure 24-10]
(0
°C to 70°C; VDD = 3.3V ± 5% for DS21352L;
0
°C to 70°C; VDD = 5.0V ± 5% for DS21552L;
-40
°C to +85°C; VDD = 3.3V ± 5% for DS21352LN;
-40
°C to +85°C; VDD = 5.0V ± 5% for DS21552LN)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
RCLKO Period
tLP
648
ns
RCLKO Pulse Width
tLH
tLL
200
324
ns
1
RCLKO Pulse Width
tLH
tLL
150
324
ns
2
RCLKI Period
tCP
648
ns
RCLKI Pulse Width
tCH
tCL
75
ns
RSYSCLK Period
tSP
100
648
488
244
122
ns
3
4
5
6
RSYSCLK Pulse Width
tSH
tSL
50
ns
RSYNC Set Up to RSYSCLK Falling
tSU
20
tSH –5
ns
RSYNC Pulse Width
tPW
50
ns
RPOSI/RNEGI Set Up to RCLKI
Falling
tSU
20
ns
RPOSI/RNEGI Hold From RCLKI
Falling
tHD
20
ns
RSYSCLK/RCLKI Rise and Fall
Times
tR, tF
25
ns
Delay RCLKO to RPOSO, RNEGO
Valid
tDD
50
ns
Delay RCLK to RSER, RDATA,
RSIG, RLINK Valid
tD1
50
ns
Delay RCLK to RCHCLK, RSYNC,
RCHBLK, RFSYNC, RLCLK
tD2
50
ns
Delay RSYSCLK to RSER, RSIG
Valid
tD3
50
ns
Delay RSYSCLK to RCHCLK,
RCHBLK, RMSYNC, RSYNC, CO
tD4
50
ns
CI Set Up to RSYSCLK Rising
tSC
20
ns
CI Pulse Width
tWC
50
ns
NOTES:
1. Jitter attenuator enabled in the receive path.
4. RSYSCLK = 2.048 MHz.
2. Jitter attenuator disabled or enabled in the transmit path.
5. RSYSCLK = 4.096 MHz
3. RSYSCLK = 1.544 MHz.
6. RSYSCLK = 8.192 MHz
Figure24-8 RECEIVE SIDE TIMING
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PDF描述 |
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參數(shù)描述 |
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| DS21554 | 制造商:Maxim Integrated Products 功能描述: |
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| DS21554GN | 功能描述:IC TXRX E1 1-CHIP 5V 100-BGA RoHS:否 類別:集成電路 (IC) >> 接口 - 電信 系列:- 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS 產(chǎn)品變化通告:Product Discontinuation 06/Feb/2012 標(biāo)準(zhǔn)包裝:750 系列:* |
| DS21554L | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC 3.3/5V E1 Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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