參數(shù)資料
型號(hào)： DS21Q50LN
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 27/87頁(yè)
文件大?。?/td> 0K
描述： IC TRANSCEIVER E1 QD IND 100LQFP
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
產(chǎn)品變化通告： Product Discontinuation 20/Feb/2012
標(biāo)準(zhǔn)包裝： 90
功能： 收發(fā)器
接口： E1
電路數(shù)： 4
電源電壓： 3.14 V ~ 3.47 V
電流 - 電源： 230mA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
供應(yīng)商設(shè)備封裝： 100-LQFP（14x14）
包裝： 托盤(pán)
包括： AIS 警報(bào)檢測(cè)器和發(fā)生器，回送功能，PRBS 發(fā)生器 / 檢測(cè)器，遠(yuǎn)程檢測(cè)器和發(fā)生器
DS21Q50
33 of 87
Register Name:
RIR
Register Description:
Receive Information Register
Register Address:
08 Hex
Bit
7
6
5
4
3
2
1
0
Name
RGM1
RGM0
JALT
RESF
RESE
CRCRC
FASRC
CASRC
NAME
BIT
FUNCTION
RGM1
7
Receive Gain Monitor Bit 1. See the Level Indication table below for level indication.
RGM0
6
Receive Gain Monitor Bit 0. See the Level Indication table below for level indication.
JALT
5
Jitter Attenuator Limit Trip. Set when the jitter attenuator FIFO reaches to within 4 bits of
its limit; useful for debugging jitter attenuation operation.
RESF
4
Receive Elastic Store Full. Set when the receive elastic store buffer fills and a frame is
deleted.
RESE
3
Receive Elastic Store Empty. Set when the receive elastic store buffer empties and a frame
is repeated.
CRCRC
2
CRC Resync Criteria Met. Set when 915/1000 codewords are received in error.
FASRC
1
FAS Resync Criteria Met. Set when three consecutive FAS words are received in error.
CASRC
0
CAS Resync Criteria Met. Set when two consecutive CAS MF alignment words are
received in error.
LEVEL INDICATION
RGM1
RGM0
LEVEL (dB)
0
0 to 10
0
1
10 to 20
1
0
20 to 30
1
>30
相關(guān)PDF資料
PDF描述
DS21Q55 IC TXRX QUAD T1/E1/J1 SCT 256BGA
DS21Q59LN+ IC TXRX E1 QUAD 100-LQFP
DS21S07AS+T&R IC TERMINATOR SCSI 16-SOIC
DS21T05Z/T&R IC TERMINATOR SCSI 150MIL 16SOIC
DS21T07S+T&R IC TERMINATOR SCSI 16-SOIC
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參數(shù)描述
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