參數(shù)資料
型號(hào)： DS21Q55
廠商： Electronic Theatre Controls, Inc.
英文描述： Quad T1/E1/J1 Transceiver
中文描述： 四路T1/E1/J1收發(fā)器
文件頁(yè)數(shù)： 144/237頁(yè)
文件大?。?/td> 1438K
代理商： DS21Q55
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DS21Q55 Quad T1/E1/J1 Transceiver
144 of 237
21.4 Receive HDLC Code Example
The following is an example of a receive HDLC routine:
1)
Reset receive HDLC controller.
2)
Set HDLC mode, mapping, and high watermark.
3)
Start new message buffer.
4)
Enable RPE and RHWM interrupts.
5)
Wait for interrupt.
6)
Disable RPE and RHWM interrupts.
7)
Read HxRPBA register. N = HxRPBA (lower 7 bits are byte count, MSB is status).
8)
Read (N and 7Fh) bytes from receive FIFO and store in message buffer.
9)
Read INFO5 register.
10)
If PS2, PS1, PS0 = 000, then go to Step 4.
11)
If PS2, PS1, PS0 = 001, then packet terminated OK, save present message buffer.
12)
If PS2, PS1, PS0 = 010, then packet terminated with CRC error.
13)
If PS2, PS1, PS0 = 011, then packet aborted.
14)
If PS2, PS1, PS0 = 100, then FIFO overflowed.
15)
Go to Step 3.
21.5 Legacy FDL Support (T1 Mode)
21.5.1 Overview
To provide backward compatibility to the older DS21x52 T1 device, the DS21Q55 maintains the circuitry
that existed in the previous generation of the T1 framer. In new applications, it is recommended that the
HDLC controllers and BOC controller described in Section
19
and
21
are used.
21.5.2 Receive Section
In the receive section, the recovered FDL bits or Fs bits are shifted bit-by-bit into the receive FDL
register (RFDL). Because the RFDL is 8 bits in length, it fills up every 2ms (8 x 250μs). The framer
signals an external microcontroller that the buffer has filled through the SR8.3 bit. If enabled through
IMR8.3, the INT pin toggles low, indicating that the buffer has filled and needs to be read. The user has
2ms to read this data before it is lost. If the byte in the RFDL matches either of the bytes programmed
into the RFDLM1 or RFDLM2 registers, then the SR8.1 bit is set to a 1 and the INT pin toggles low if
enabled through IMR8.1. This feature allows an external microcontroller to ignore the FDL or Fs pattern
until an important event occurs.
The framer also contains a zero destuffer, which is controlled through the T1RCR2.3 bit. In both ANSI
T1.403 and TR54016, communications on the FDL follows a subset of an LAPD protocol. The LAPD
protocol states that no more than five 1s should be transmitted in a row so that the data does not resemble
an opening or closing flag (01111110) or an abort signal (11111111). If enabled through T1RCR2.3, the
device automatically looks for five 1s in a row, followed by a 0. If it finds such a pattern, it automatically
removes the zero. If the zero destuffer sees six or more 1s in a row followed by a 0, the 0 is not removed.
The T1RCR2.3 bit should always be set to a 1 when the device is extracting the FDL. Refer to
Application Note 335: DS2141A, DS2151 Controlling the FDL
for information about using the DS21Q55
in FDL applications in this legacy support mode.
相關(guān)PDF資料
PDF描述
DS21Q55N Quad T1/E1/J1 Transceiver
DS21S07A SCSI Terminator
DS21S07AE Terminator
DS21S07AS Terminator
DS21S07CE Interface IC
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參數(shù)描述
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DS21Q552+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC 5V Quad T1 Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS21Q552B 制造商:Rochester Electronics LLC 功能描述: 制造商:Maxim Integrated Products 功能描述:
DS21Q552BN 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS21Q552BN+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC 5V Quad T1 Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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