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參數(shù)資料
| 型號： | DS21Q55 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Quad T1/E1/J1 Transceiver |
| 中文描述： | 四路T1/E1/J1收發(fā)器 |
| 文件頁數(shù)： | 99/237頁 |
| 文件大小： | 1438K |
| 代理商： | DS21Q55 |
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DS21Q55 Quad T1/E1/J1 Transceiver
99 of 237
14.2.3 Software Signaling Insertion-Enable Registers, T1 Mode
In T1 mode, only registers SSIE1–SSIE3 are used since there are only 24 channels in a T1 frame.
Register Name:
SSIE1
Register Description:
Software Signaling Insertion Enable 1
Register Address:
08h
Bit #
7
6
5
4
Name
CH8
CH7
CH6
CH5
Default
0
0
0
0
Bits 0 to 7/Software Signaling Insertion Enable for Channels 1 to 8 (CH1 to CH8).
These bits determine which
channels are to have signaling inserted from the transmit signaling registers.
0 = do not source signaling data from the TSx registers for this channel
1 = source signaling data from the TSx registers for this channel
Register Name:
SSIE2
Register Description:
Software Signaling-Insertion Enable 2
Register Address:
09h
Bit #
7
6
5
4
Name
CH16
CH15
CH14
CH13
CH12
Default
0
0
0
0
Bits 0 to 7/Software Signaling Insertion Enable for Channels 9 to 16 (CH9 to CH16).
These bits determine
which channels are to have signaling inserted from the transmit signaling registers.
0 = do not source signaling data from the TSx registers for this channel
1 = source signaling data from the TSx registers for this channel
Register Name:
SSIE3
Register Description:
Software Signaling-Insertion Enable 3
Register Address:
0Ah
Bit #
7
6
5
4
Name
CH24
CH23
CH22
CH21
CH20
Default
0
0
0
0
Bits 0 to 7/Software Signaling Insertion Enable for Channels 17 to 24 (CH17 to CH24).
These bits determine
which channels are to have signaling inserted from the transmit signaling registers.
0 = do not source signaling data from the TSx registers for this channel
1 = source signaling data from the TSx registers for this channel
14.2.4 Hardware-Based Mode
In hardware-based mode, signaling data is input through the TSIG pin. This signaling PCM stream is
buffered and inserted to the data stream being input at the TSER pin.
Signaling data can be inserted on a per-channel basis by the transmit hardware-signaling channel-select
(THSCS) function. The user has the ability to control which channels are to have signaling data from the
TSIG pin inserted into them on a per-channel basis. See Section 4 for details on using this per-channel
(THSCS) feature. The signaling insertion capabilities of the framer are available whether the transmit-
side elastic store is enabled or disabled. If the elastic store is enabled, the backplane clock (TSYSCLK)
can be either 1.544MHz or 2.048MHz. Also, if the elastic is enabled in conjunction with transmit
hardware signaling, CCR3.7 must be set = 0.
3
2
1
0
CH4
0
CH3
0
CH2
0
CH1
0
3
2
1
0
CH11
0
CH10
0
CH9
0
0
3
2
1
0
CH19
0
CH18
0
CH17
0
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DS21Q55N | Quad T1/E1/J1 Transceiver |
| DS21S07A | SCSI Terminator |
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| DS21Q552+ | 功能描述:網(wǎng)絡控制器與處理器 IC 5V Quad T1 Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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