參數(shù)資料
型號： DS21Q55
廠商： Electronic Theatre Controls, Inc.
英文描述： Quad T1/E1/J1 Transceiver
中文描述： 四路T1/E1/J1收發(fā)器
文件頁數(shù)： 51/237頁
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代理商： DS21Q55
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DS21Q55 Quad T1/E1/J1 Transceiver
51 of 237
Register Name:
Register Description:
Register Address:
Bit #
Name
Default
Bit 0/Receive-Side D4 Yellow Alarm Select (RD4YM)
0 = 0s in bit 2 of all channels
1 = a 1 in the S-bit position of frame 12 (J1 Yellow Alarm Mode)
Bit 1/Receive Japanese CRC6 Enable (RJC)
0 = use ANSI/AT&T/ITU CRC6 calculation (normal operation)
1 = use Japanese standard JT–G704 CRC6 calculation
Bit 2/Receive-Side ZBTSI Support Enable (RZBTSI).
Allows ZBTSI information to be output on RLINK pin.
0 = ZBTSI disabled
1 = ZBTSI enabled
Bit 3/Receive FDL Zero-Destuffer Enable (RZSE).
Set this bit to 0 if using the internal HDLC/BOC controller
instead of the legacy support for the FDL. See Section
21.5
for details.
0 = zero destuffer disabled
1 = zero destuffer enabled
Bit 4/Receive SLC-96 Enable (RSLC96).
Only set this bit to a 1 in D4/SLC-96 framing applications. See Section
21.6 for details.
0 = SLC-96 disabled
1 = SLC-96 enabled
Bit 5/Receive B8ZS Enable (RB8ZS)
0 = B8ZS disabled
1 = B8ZS enabled
Bit 6/Receive Frame Mode Select (RFM)
0 = D4 framing mode
1 = ESF framing mode
Bit 7/Unused, must be set to 0 for proper operation
T1RCR2
T1 Receive Control Register 2
04h
7
—
0
6
5
4
3
2
1
0
RFM
0
RB8ZS
0
RSLC96
0
RZSE
0
RZBTSI
0
RJC
0
RD4YM
0
相關(guān)PDF資料
PDF描述
DS21Q55N Quad T1/E1/J1 Transceiver
DS21S07A SCSI Terminator
DS21S07AE Terminator
DS21S07AS Terminator
DS21S07CE Interface IC
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參數(shù)描述
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