參數(shù)資料
型號： DS26503LN+
廠商： Maxim Integrated Products
文件頁數(shù)： 104/122頁
文件大?。?/td> 0K
描述： IC T1/E1/J1 BITS ELEMENT 64-LQFP
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 160
類型： BITS 元件，多路復(fù)用器
PLL： 是
主要目的： T1/E1
輸入： 時鐘
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 無/無
頻率 - 最大： 6.312MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-LQFP
供應(yīng)商設(shè)備封裝： 64-LQFP（10x10）
包裝： 托盤
產(chǎn)品目錄頁面： 1430 (CN2011-ZH PDF)
DS26503 T1/E1/J1 BITS Element
82 of 122
13.7 LIU Control Registers
Register Name:
LIC1
Register Description:
Line Interface Control 1
Register Address:
30h
Bit #
7
6
5
4
3
2
1
0
Name
L2
L1
L0
EGL
JAS
JABDS
DJA
TPD
Default
0
HW
Mode
L2
PIN 13
L1
PIN 12
L0
PIN 11
0
1
Bit 0: Transmit Power-Down (TPD)
0 = powers down the transmitter and three-states the TTIP and TRING pins
1 = normal transmitter operation
Bit 1: Disable Jitter Attenuator (DJA)
0 = jitter attenuator enabled
1 = jitter attenuator disabled
Bit 2: Jitter Attenuator Buffer Depth Select (JABDS)
0 = 128 bits
1 = 32 bits (use for delay-sensitive applications)
Bit 3: Jitter Attenuator Select (JAS)
0 = place the jitter attenuator on the receive side
1 = place the jitter attenuator on the transmit side
Bit 4: Receive Equalizer Gain Limit (EGL). This bit controls the sensitivity of the receive equalizer.
T1 Mode: 0 = -36dB (long haul)
1 = -15dB (limited long haul)
E1 Mode: 0 = -43dB (long haul)
1 = -12dB (short haul)
Bits 5 to 7: Line Build-Out Select (L0 to L2). When using the internal termination, the user needs only to select 000 for 75
operation or 001 for 120 operation. This selects the proper voltage levels for 75 or 120 operation. Using TT0, TT1, and
TT2 of the LICR4 register, users can then select the proper internal source termination. Line build-outs 100 and 101 are for
backwards compatibility with older products only.
E1 Mode
L2
L1
L0
APPLICATION
N
(NOTE 1)
RETURN LOSS
Rt
(NOTE 1)
0
75 normal
1:2
N.M.
0
1
120 normal
1:2
N.M.
0
1
0
75 with high return loss (Note 2)
1:2
21dB
6.2
1
0
1
120 with high return loss (Note 2)
1:2
21dB
11.6
Note 1: Transformer turns ratio.
Note 2: TT0, TT1, and TT2 of LIC4 register must be set to zero in this configuration.
N.M. = not meaningful
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