參數(shù)資料
型號(hào)： DS26503LN+
廠商： Maxim Integrated Products
文件頁數(shù)： 50/122頁
文件大?。?/td> 0K
描述： IC T1/E1/J1 BITS ELEMENT 64-LQFP
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 160
類型： BITS 元件，多路復(fù)用器
PLL： 是
主要目的： T1/E1
輸入： 時(shí)鐘
輸出： 時(shí)鐘
電路數(shù)： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 無/無
頻率 - 最大： 6.312MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-LQFP
供應(yīng)商設(shè)備封裝： 64-LQFP（10x10）
包裝： 托盤
產(chǎn)品目錄頁面： 1430 (CN2011-ZH PDF)
DS26503 T1/E1/J1 BITS Element
33 of 122
ADDRESS
TYPE
REGISTER NAME
REGISTER
ABBREVIATION
44
R/W
Transmit Remote Alarm Bits
45
R/W
Transmit Sa4 Bits
46
R/W
Transmit Sa5 Bits
47
R/W
Transmit Sa6 Bits
48
R/W
Transmit Sa7 Bits
49
R/W
Transmit Sa8 Bits
4A
R/W
Transmit Sa Bit Control Register
4B-4F
—
Reserved
—
50
R
Receive FDL Register
51
R/W
Transmit FDL Register
52
R/W
Receive Facility Data Link Match Register 1
53
R/W
Receive Facility Data Link Match Register 2
54-55
—
Reserved
—
56
R
Receive Align Frame Register
57
R
Receive Non-Align Frame Register
58
R
Receive Si Align Frame
59
R
Receive Si Non-Align Frame
5A
R
Receive Remote Alarm Bits
5B
R
Receive Sa4 Bits
5C
R
Receive Sa5 Bits
5D
R
Receive Sa6 Bits
5E
R
Receive Sa7 Bits
5F
R
Receive Sa8 Bits
60-EF
—
Reserved
—
F0
R/W
Test Register 1
TEST1*
F1
R/W
Test Register 2
TEST2*
F2
R/W
Test Register 3
TEST3*
F3
R/W
Test Register 4
TEST4*
F4
R/W
Test Register 5
TEST5*
F5
R/W
Test Register 6
TEST6*
F6
R/W
Test Register 7
TEST7*
F7
R/W
Test Register 8
TEST8*
F8
R/W
Test Register 9
TEST9*
F9
R/W
Test Register 10
TEST10*
FA
R/W
Test Register 11
TEST11*
FB
R/W
Test Register 12
TEST12*
FC
R/W
Test Register 13
TEST13*
FD
R/W
Test Register 14
TEST14*
FE
R/W
Test Register 15
TEST15*
FF
R/W
Test Register 16
TEST16*
*TEST1 to TEST16 registers are used only by the factory.
相關(guān)PDF資料
PDF描述
DS3105LN+ IC TIMING LINE CARD 64-LQFP
DS3106LN+ IC TIMING LINE CARD 64-LQFP
DS3231MZ+ IC RTC I2C 8SOIC
DS3231SN#T&R IC RTC W/TCXO 16-SOIC
DS3232MZ+ IC RTC W/SRAM I2C 8SOIC
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參數(shù)描述
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