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參數(shù)資料
| 型號： | DS26503LN+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 54/122頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC T1/E1/J1 BITS ELEMENT 64-LQFP |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 160 |
| 類型： | BITS 元件，多路復(fù)用器 |
| PLL： | 是 |
| 主要目的： | T1/E1 |
| 輸入： | 時鐘 |
| 輸出： | 時鐘 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 6.312MHz |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-LQFP |
| 供應(yīng)商設(shè)備封裝： | 64-LQFP（10x10） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 1430 (CN2011-ZH PDF) |
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DS26503 T1/E1/J1 BITS Element
37 of 122
Register Name:
TPCR
Register Description:
Transmit PLL Control Register
Register Address:
09h
Bit #
7
6
5
4
3
2
1
0
Name
TPLLOFS1
TPLLOFS0
PLLOS
TPLLIFS1
TPLLIFS0
TPLLSS
TCSS1
TCSS0
Default
0
HW
Mode
0
TCSS1
PIN 31
TCSS0
PIN 63
For more information on all the bits in the Transmit PLL control register, refer to Figure 3-3.
Bits 0 and 1: Transmit Clock (TX CLOCK) Source Select (TCSS[1:0]). These bits control the output of the TX PLL
Clock Mux function. See Figure 3-3.
TCSS1
TCSS0
Transmit Clock (TX CLOCK) Source
(See Figure 3-3)
0
The TCLK pin is the source of transmit clock.
0
1
The PLL_CLK is the source of transmit clock.
1
0
The scaled signal present at MCLK as the transmit clock.
1
The signal present at RCLK is the transmit clock.
Bit 2: Transmit PLL_CLK Source Select (TPLLSS). Selects the reference signal for the TX PLL.
0 = Use the recovered network clock. This is the same clock available at the RCLK pin (output).
1 = Use the externally provided clock present at the TCLK pin.
Bit 3 and 4: Transmit PLL Input Frequency Select (TPLLIFS[0:1]). These bits are used to indicate the reference
frequency being input to the TX PLL.
TPLLIFS1
TPLLIFS0
Input Frequency
0
1.544MHz
0
1
2.048MHz
1
0
—
1
6312kHz
Bit 5: PLL_OUT Select (PLLOS). This bit selects the source for the PLL_OUT pin. See Figure 3-3.
0 = PLL_OUT is sourced directly from the TX PLL.
1 = PLL_OUT is the output of the TX PLL mux.
Bits 6 and 7: Transmit PLL Output Frequency Select (TPLLOFS[0:1]). These bits are used to select the TX PLL output
frequency.
TPLLOFS1
TPLLOFS0
Output Frequency
0
1.544MHz
0
1
2.048MHz
1
0
—
1
6312kHz
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DS3105LN+ | IC TIMING LINE CARD 64-LQFP |
| DS3106LN+ | IC TIMING LINE CARD 64-LQFP |
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| DS3232MZ+ | IC RTC W/SRAM I2C 8SOIC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| DS26504L | 功能描述:計時器和支持產(chǎn)品 E1/T1/J1/64Kcc Bits Element RoHS:否 制造商:Micrel 類型:Standard 封裝 / 箱體:SOT-23 內(nèi)部定時器數(shù)量:1 電源電壓-最大:18 V 電源電壓-最小:2.7 V 最大功率耗散: 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝:Reel |
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