參數(shù)資料
型號： DS31256+
廠商： Maxim Integrated Products
文件頁數(shù)： 11/183頁
文件大?。?/td> 0K
描述： IC CTRLR HDLC 256-CHANNEL 256BGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 40
控制器類型： HDLC 控制器
接口： 串行
電源電壓： 3 V ~ 3.6 V
電流 - 電源： 500mA
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 256-BBGA
供應(yīng)商設(shè)備封裝： 256-BGA（27x27）
包裝： 管件
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁當前第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁
DS31256 256-Channel, High-Throughput HDLC Controller
108 of 183
Figure 9-10. Transmit DMA Operation
00h
08h
Done-Queue Descriptors
(circular queue)
04h
Free Desc. Ptr.
CH#5
Status
Free Desc. Ptr.
CH#1
Status
Free Desc. Ptr.
CH#
Status
00h
Pending-Queue Descriptors
(circular queue)
04h
Free Desc. Ptr.
CH#5
PRI
Free Desc. Ptr.
CH#1
PRI
Data Buffer Address
CH #1
EOF
Last Transmitted
Data Buffer
for Channel 1
# Bytes Next Desc. Ptr.
Next Pend. Desc.
PV
CV
unused
Data Buffer Address
CH #1
EOF
2nd Transmitted
Data Buffer
for Channel 1
# Bytes Next Desc. Ptr.
Next Pend. Desc.
PV
CV
unused
Data Buffer Address
CH #1
EOF
1st Transmitted
Data Buffer
for Channel 1
# Bytes Next Desc. Ptr.
Next Pend. Desc.
PV
CV
unused
Data Buffer Address
CH #5
EOF
1st Queued
Data Buffer
for Channel 5
# Bytes Next Desc. Ptr.
Next Pend. Desc.
PV
CV
unused
Data Buffer Address
CH #5
EOF
2nd Queued
Data Buffer
for Channel 5
# Bytes Next Desc. Ptr.
Next Pend. Desc.
PV
CV
unused
Data Buffer Address
CH #5
EOF
Last Queued
Data Buffer
for Channel 5
# Bytes Next Desc. Ptr.
Next Pend. Desc.
PV
CV
unused
Data Buffer Address
CH #1
EOF
Queued
Data Buffer
for Channel 1
# Bytes Next Desc. Ptr.
Next Pend. Desc.
PV
CV
unused
Open Descriptor Space
Available for Use by the Host
Data Buffer Address
CH #5
EOF
Transmitted
Data Buffer
for Channel 5
# Bytes Next Desc. Ptr.
Next Pend. Desc.
PV
CV
unused
08h
0Ch
Free Desc. Ptr.
CH#
PRI
Free Desc. Ptr.
CH#
PRI
Open Descriptor Space
Available for Use by the Host
0Ch
14h
10h
Free Desc. Ptr.
CH#
Status
Free Desc. Ptr.
CH#
Status
Free Desc. Ptr.
CH#
Status
EOF = 0
EOF = 1
EOF = 0
EOF = 1
EOF = 0
EOF = 1
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PDF描述
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參數(shù)描述
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DS31256B 功能描述:輸入/輸出控制器接口集成電路 256Ch High Thruput HDLC Cntlr RoHS:否 制造商:Silicon Labs 產(chǎn)品: 輸入/輸出端數(shù)量: 工作電源電壓: 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-64 封裝:Tray
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