參數(shù)資料
型號： DS3174N
英文描述： Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers
中文描述： 單/雙/三/四DS3/E3單芯片收發(fā)器
文件頁數(shù)： 57/232頁
文件大?。?/td> 2133K
代理商： DS3174N
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DS3171/DS3172/DS3173/DS3174
57 of 230
10.2.3 Line IO Pin Timing Source Selection
The line IO pins can use any input clock pin (RLCLKn or TCLKIn) or output clock pin (TLCLKn, RCLKOn, or
TCLKOn) for its clock pin and meet the AC timing specifications as long as the clock signal is valid for the mode the
part is in. The clock select bit for the transmit line IO signal group
PORT.CR3
.TLTS selects the correct input or
output clock timing.
10.2.3.1 Transmit Line Interface Pins Timing Source Selection
(TPOSn/TDATn, TNEGn)
The transmit line interface signal pin group has the same functional timing clock source as the TLCLKn pin
described in
Table 10-3
. Other clock pins can be used for the external timing. The TLCLKn transmit line clock
output pin is always a valid output clock for external logic to use for these signals when
PORT.CR3
.TLTS=0.
The transmit line timing select bit (TLTS) is used to select input or output clock pin timing. When TLTS=0, output
clock timing is selected. When TLTS=1, input clock timing is selected. If TLTS is set for input clock timing and an
output clock pin is used, or if TLTS is set for output clock timing and an input clock pin is used, then the setup, hold
and delay timings, as specified in
The generic
timing definitions shown in
Figure 18-1,
Figure 18-2,
Figure 18-3,
and
Figure 18-6
apply to this interface.
Table 18-1.
,
will not be valid. There are some combinations of TLTS=1 and other modes in which there is no input
clock pin available for external timing since the clock source is derived internally from the RX LIU or the CLAD.
Table 10-6. Transmit Line Interface Signal Pin Valid Timing Source Select
L
LBM[2:0]
L
C
T
Valid Timing to These Clock Pins
1
1
1
0
0
0
0
XXX
XXX
XXX
X
0
1
X
X
X
X
X
X
X
X
X
X
X
0
1
1
0
0
0
0
TLCLKn, TCLKOn, RCLKOn
RLCLKn
No valid timing to any input clock pin
TLCLKn, TCLKOn, RCLKOn
TLCLKn, RCLKOn
TLCLKn
TLCLKn, TCLKOn (default)
DLB (100)
LLB (010) or PLB (011)
DLB&LLB (110)
not DLB (100),
not LLB (010), not PLB (011)
and not LLB&DLB (110)
not LLB (010) and not PLB (011)
and not LLB&DLB (110)
not LLB (010) and not PLB (011)
and not LLB&DLB (110)
LLB (010) or PLB (011)
or DLB&LLB (110)
LLB (010) or PLB (011)
or DLB&LLB (110)
0
X
0
1
No valid timing to any input clock pin
0
X
1
1
TCLKIn
0
0
X
1
RLCLKn
0
1
X
1
No valid timing to any input clock pin
10.2.3.2 Transmit Framer Pin Timing Source Selection
(TSERn, TSOFIn, TSOFOn/TDENn)
The transmit framer signal pin group has the same functional timing clock source as the TCLKO pin described in
Table 10-4
. Other clock pins can be used for the external timing. The TCLKO transmit clock output pin is always a
valid output clock for external logic to use for these signals when TFTS=0.
The transmit framer select bit (TFTS) is used to select input or output clock pin timing. When TFTS=0, output clock
timing is selected. When TFTS=1, input clock timing is selected. If TFTS is set for input clock timing and an output
clock pin is used, or If TFTS is set for output clock timing and an input clock pin is used, then the setup, hold and
delay timings, as specified in
The generic
timing definitions shown in
Figure 18-1,
Figure 18-2,
Figure 18-3,
and
Figure 18-6
apply to this interface.
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PDF描述
DS318PIN Industrial Control IC
DS319 Two-Way Power Divider 10500 MHz
DS109333 Two-Way Power Divider 10500 MHz
DS322 32 Megabit (4 M x 8-Bit/2 M x 16-Bit) CMOS 1.8 Volt-only, Simultaneous Operation Flash Memory
DS323 32 Megabit (4 M x 8-Bit/2 M x 16-Bit) CMOS 1.8 Volt-only, Simultaneous Operation Flash Memory
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參數(shù)描述
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DS3177+ 制造商:Maxim Integrated Products 功能描述:IC TXRX DS3/E3 CSBGA
DS3177N+ 制造商:Maxim Integrated Products 功能描述:DS3/E3 SINGLE-CHIP TRANSCEIVER - Rail/Tube 制造商:Maxim Integrated Products 功能描述:IC TXRX DS3/E3 CSBGA
DS3177N+T 制造商:Maxim Integrated Products 功能描述:DS3/E3 SINGLE-CHIP TRANSCEIVER - Tape and Reel
DS-318 制造商:MA-COM 制造商全稱:M/A-COM Technology Solutions, Inc. 功能描述:Plug-In Two-Way Power Divider, 5 - 500 MHz
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