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參數資料
| 型號： | DSP56303AG100 |
| 廠商： | Freescale Semiconductor |
| 文件頁數： | 48/108頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP 24BIT 100MHZ 144-LQFP |
| 特色產品： | DSP56303 24-bit Digital Signal Processor |
| 標準包裝： | 60 |
| 系列： | DSP563xx |
| 類型： | 定點 |
| 接口： | 主機接口，SSI，SCI |
| 時鐘速率： | 100MHz |
| 非易失內存： | ROM（576 B） |
| 芯片上RAM： | 24kB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 3.30V |
| 工作溫度： | -40°C ~ 100°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 144-LQFP |
| 供應商設備封裝： | 144-LQFP（20x20） |
| 包裝： | 托盤 |
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DSP56303 Technical Data, Rev. 11
2-24
Freescale Semiconductor
Specifications
2.5.5.3 Synchronous Timings
Table 2-13.
External Bus Synchronous Timings1,2
No.
Characteristics
Expression3,4,5
100 MHz
Unit
Min
Max
198
CLKOUT high to address, and AA valid
6
0.25
× TC + 4.0
—
6.5
ns
199
CLKOUT high to address, and AA invalid6
0.25
× T
C
2.5
—
ns
200
TA valid to CLKOUT high (set-up time)
4.0
—
ns
201
CLKOUT high to TA invalid (hold time)
0.0
—
ns
202
CLKOUT high to data out active
0.25
× TC
2.5
—
ns
203
CLKOUT high to data out valid
0.25
× T
C + 4.0
—
6.5
ns
204
CLKOUT high to data out invalid
0.25
× TC
2.5
—
ns
205
CLKOUT high to data out high impedance
0.25
× T
C
—2.5
ns
206
Data in valid to CLKOUT high (set-up)
4.0
—
ns
207
CLKOUT high to data in invalid (hold)
0.0
—
ns
208
CLKOUT high to RD assertion
maximum: 0.75
× TC + 2.5
6.7
10.0
ns
209
CLKOUT high to RD deassertion
0.0
4.0
ns
210
CLKOUT high to WR assertion
2
maximum: 0.5
× TC + 4.3
for WS = 1 or WS
≥ 4
for 2
≤WS ≤3
5.0
0.0
9.3
4.3
ns
211
CLKOUT high to WR deassertion
0.0
3.8
ns
Notes:
1.
Use external bus synchronous timings only for reference to the clock and
not for relative timings.
2.
Synchronous Bus Arbitration is not recommended. Use Asynchronous mode whenever possible.
3.
WS is the number of wait states specified in the BCR.
4.
If WS > 1, WR assertion refers to the next rising edge of CLKOUT.
5.
Use the expression to compute the maximum or minimum value listed, as appropriate. For timing 210, the minimum is an
absolute value.
6.
T198 and T199 are valid for Address Trace mode if the ATE bit in the Operating Mode Register is set. when this mode is
enabled, use the status of BR (See T212) to determine whether the access referenced by A[0–17] is internal or external.
相關PDF資料 |
PDF描述 |
|---|---|
| V300A3V3E264BL3 | CONVERTER MOD DC/DC 3.3V 264W |
| KRM55WR72A156MH01K | CAP CER 15UF 100V 20% X7R 2220 |
| VI-B51-CY-F2 | CONVERTER MOD DC/DC 12V 50W |
| MLP2012S4R7M | INDUCTOR MULTILAYER 4.7UH 0805 |
| DSPB56374AE | IC DSP 24BIT 150MHZ 52-LQFP |
相關代理商/技術參數 |
參數描述 |
|---|---|
| DSP56303AG100B1 | 功能描述:數字信號處理器和控制器 - DSP, DSC 24 BIT DSP RoHS:否 制造商:Microchip Technology 核心:dsPIC 數據總線寬度:16 bit 程序存儲器大小:16 KB 數據 RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數量:35 定時器數量:3 設備每秒兆指令數:50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT |
| DSP56303AG100R2 | 功能描述:數字信號處理器和控制器 - DSP, DSC 24 BIT DSP RoHS:否 制造商:Microchip Technology 核心:dsPIC 數據總線寬度:16 bit 程序存儲器大小:16 KB 數據 RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數量:35 定時器數量:3 設備每秒兆指令數:50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT |
| DSP56303EVM | 功能描述:數字信號處理器和控制器 - DSP, DSC DSP56303 Eval Kit RoHS:否 制造商:Microchip Technology 核心:dsPIC 數據總線寬度:16 bit 程序存儲器大小:16 KB 數據 RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數量:35 定時器數量:3 設備每秒兆指令數:50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT |
| DSP56303EVMCL | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DSP56303EVM DSP56303EVM Kit Contents List |
| DSP56303EVMUM | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DSP56303 EVM Users Manual |
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