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參數(shù)資料
| 型號： | DSP56366UM |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 24-Bit Audio Digital Signal Processor |
| 中文描述： | 24位音頻數(shù)字信號處理器 |
| 文件頁數(shù)： | 69/110頁 |
| 文件大?。?/td> | 1273K |
| 代理商： | DSP56366UM |
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DSP56366 Technical Data, Rev. 3.1
Freescale Semiconductor
3-43
Figure 3-26 Host DMA Read Timing Diagram
3.12
Serial Host Interface SPI Protocol Timing
Table 3-19 Serial Host Interface SPI Protocol Timing
No.
Characteristics
1
Mode
Filter
Mode
Expression
Min
Max
Unit
140
Tolerable spike width on clock or data in
—
Bypassed
—
—
0
ns
Narrow
—
—
50
ns
Wide
—
—
100
ns
141
Minimum serial clock cycle =
t
SPICC
(min)
Master
Bypassed
6
×
T
C
+46
96
—
ns
Narrow
6
×
T
C
+152
202
—
ns
Wide
6
×
T
C
+223
273
—
ns
142
Serial clock high period
Master
Bypassed
0.5
×
t
SPICC
–10
38
—
ns
Narrow
0.5
×
t
SPICC
–10
91
—
ns
Wide
0.5
×
t
SPICC
–10
126.5
—
ns
Slave
Bypassed
2.5
×
T
C
+12
32.8
—
ns
Narrow
2.5
×
T
C
+102
122.8
—
ns
Wide
2.5
×
T
C
+189
209.8
—
ns
326
317
318
327
328
329
Data
Valid
HOREQ
(Output)
HACK
(Input)
H0-H7
(Output)
RXH
Read
343
342
342
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DSP56367P | 24-Bit Audio Digital Signal Processor |
| DSP56367UM | 24-Bit Audio Digital Signal Processor |
| DSP56600 | Implementing Viterbi Decoders Using the VSL Instruction on DSP Families |
| DSP56852E | 16-bit Digital Signal Controllers |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DSP56367 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Optoelectronic |
| DSP56367P | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:24-Bit Audio Digital Signal Processor |
| DSP56367UM | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:24-Bit Audio Digital Signal Processor |
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| DSP56371AF180 | 制造商:Freescale Semiconductor 功能描述: |
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