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參數(shù)資料
| 型號： | DSP56366UM |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 24-Bit Audio Digital Signal Processor |
| 中文描述： | 24位音頻數(shù)字信號處理器 |
| 文件頁數(shù)： | 77/110頁 |
| 文件大?。?/td> | 1273K |
| 代理商： | DSP56366UM |
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DSP56366 Technical Data, Rev. 3.1
Freescale Semiconductor
3-51
186 First SCL sampling edge to HREQ output
deassertion
T
NG;RQO
ns
Filters bypassed
2
×
T
C
+ 30
—
46.7
—
46.7
Narrow filters enabled
2
×
T
C
+ 120
—
136.7
—
136.7
Wide filters enabled
2
×
T
C
+ 208
—
224.7
—
224.7
187 Last SCL edge to HREQ output not
deasserted
T
AS;RQO
ns
Filters bypassed
2
×
T
C
+ 30
46.7
—
46.7
—
Narrow filters enabled
2
×
T
C
+ 80
96.7
—
96.7
—
Wide filters enabled
2
×
T
C
+ 135
151.6
—
151.6
—
188 HREQ in assertion to first SCL edge
T
AS;RQI
0.5
×
T
I
2
CCP
-
0.5
×
T
C
- 21
ns
Filters bypassed
4440
—
1041
—
Narrow filters enabled
4373
—
999
—
Wide filters enabled
4373
—
958
—
189 First SCL edge to HREQ in not asserted
(HREQ in hold time)
t
HO;RQI
0.0
—
0.0
—
ns
1
V
CC
= 3.16 V ± 0.16 V; T
J
= –40°C to +110°C
2
Pull-up resistor: R
P
(min) = 1.5 kOhm
3
Capacitive load: C
b
(max) = 400 pF
4
It is recommended to enable the wide filters when operating in the I
2
C Standard Mode.
5
It is recommended to enable the narrow filters when operating in the I
2
C Fast Mode.
Table 3-20 SHI I
2
C Protocol Timing (continued)
No.
Characteristics
1,2,3
Symbol/
Expression
Standard
Mode
4
Fast Mode
5
Unit
Min
Max
Min
Max
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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