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參數(shù)資料
| 型號： | EMBEDDED INTEL486 SX |
| 廠商： | Intel Corp. |
| 英文描述： | Embedded INTEL486 SX Processor(嵌入式INTEL486 SX處理器) |
| 中文描述： | 山西嵌入式英特爾486處理器（嵌入式英特爾486山西處理器） |
| 文件頁數(shù)： | 37/48頁 |
| 文件大?。?/td> | 532K |
| 代理商： | EMBEDDED INTEL486 SX |
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Embedded Intel486 SX Processor
33
Figure 4. CLK Waveform
Table 22. AC Specifications for the Test Access Port
(Both 3.3V SQFP and 5V PQFP Processors)
T
CASE
= 0
°
C to +85
°
C; C
L
= 50 pF
Parameter
TCK Frequency
TCK Period
TCK High Time
TCK Low Time
TCK Rise Time
TCK Fall Time
TDI, TMS Setup Time
TDI, TMS Hold Time
TDO Valid Delay
TDO Float Delay
All Outputs (except TDO) Valid Delay
All Outputs (except TDO) Float Delay
All Inputs (except TDI, TMS, TCK) Setup Time
All Inputs (except TDI, TMS, TCK) Hold Time
Symbol
t
24
t
25
t
26
t
27
t
28
t
29
t
30
t
31
t
32
t
33
t
34
t
35
t
36
t
37
NOTES:
1. TCK period
≤
CLK period.
2. Rise/Fall times are measured between 0.8V and 2.0V. Rise/Fall times can be relaxed by 1 ns per 10-ns increase in TCK
period.
3. Parameters t
30
– t
37
are measured from TCK.
Min
Max
8
Unit
MHz
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
Figure
Notes
Note 1
@ 2.0V
@ 0.8V
Note 2
Note 2
Note 3
Note 3
Note 3
Note 3
Note 3
Note 3
Note 3
Note 3
125
40
40
10
10
10
10
10
11
11
11
11
11
11
11
11
8
8
8
10
3
30
36
30
36
3
8
10
1.5 V
0.8 V
t
1
t
5
t
2
t
4
t
3
CLK
2.0 V
t
x
t
y
1.5 V
t
x
= input setup times
t
y
= input hold times, output float, valid and hold times
1.5 V
0.8 V
2.0 V
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