參數(shù)資料
型號： EP2AGX65DF25C5N
廠商： Altera
文件頁數(shù)： 25/90頁
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描述： IC ARRIA II GX FPGA 65K 572FBGA
產(chǎn)品培訓(xùn)模塊： Arria II GX FPGA
Three Reasons to Use FPGA's in Industrial Designs
特色產(chǎn)品： Arria? II GX FPGAs
標準包裝： 5
系列： Arria II GX
LAB/CLB數(shù)： 2530
邏輯元件/單元數(shù)： 60214
RAM 位總計： 5371904
輸入/輸出數(shù)： 252
電源電壓： 0.87 V ~ 0.93 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 572-FBGA
供應(yīng)商設(shè)備封裝： 572-FBGA
其它名稱： 544-2641
Ch
ap
te
r
1:
De
vice
Da
ta
sh
e
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r
Arria
II
De
vice
s
1–2
3
Switc
h
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C
h
ar
acter
istics
Dec
ember
2013
Alte
ra
Cor
p
oration
A
fixedclk
clock
frequency
PCIe
Receiver
Detect
—
125
—
125
—
125
—
125
—
MHz
reconfig_
clk
clock
frequency
Dynamic
reconfig.
clock
frequency
2.5/
37.5
—50
2.5/
37.5
—50
2.5/
37.5
—50
2.5/
37.5
—50
MHz
Delta time
between
reconfig_
clks
——
—
2
—
2
—
2
—
2
ms
Transceiver block
minimum
power-down
pulse width
——
1
—
1
—
1
—
1
—
s
Receiver
Supported I/O
Standards
1.4-V PCML, 1.5-V PCML, 2.5-V PCML, 2.5-V PCML, LVPECL, and LVDS
—
600
—
6375
600
—
3750
600
—
3750
600
—
3125
Mbps
Absolute VMAX
for a receiver pin
—
1.5
—
1.5
—
1.5
—
1.5
V
Absolute VMIN for
a receiver pin
—
-0.4
—
-0.4
—
-0.4
—
-0.4
—
V
Maximum
peak-to-peak
differential input
voltage VID (diff
p-p)
VICM = 0.82 V
setting
—
2.7
—
2.7
—
2.7
—
2.7
V
VICM =1.1 V
setting (7)
—
1.6
—
1.6
—
1.6
—
1.6
V
Table 1–34. Transceiver Specifications for Arria II GX Devices (Note 1) (Part 3 of 7)
Symbol/
Description
Condition
I3
C4
C5 and I5
C6
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
相關(guān)PDF資料
PDF描述
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