參數(shù)資料
型號： EP2AGX65DF25C5N
廠商： Altera
文件頁數(shù)： 43/90頁
文件大?。?/td> 0K
描述： IC ARRIA II GX FPGA 65K 572FBGA
產(chǎn)品培訓模塊： Arria II GX FPGA
Three Reasons to Use FPGA's in Industrial Designs
特色產(chǎn)品： Arria? II GX FPGAs
標準包裝： 5
系列： Arria II GX
LAB/CLB數(shù)： 2530
邏輯元件/單元數(shù)： 60214
RAM 位總計： 5371904
輸入/輸出數(shù)： 252
電源電壓： 0.87 V ~ 0.93 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 572-FBGA
供應商設備封裝： 572-FBGA
其它名稱： 544-2641
1–40
Chapter 1: Device Datasheet for Arria II Devices
Switching Characteristics
December 2013
Altera Corporation
Total jitter
(peak-to-peak)
Pattern = CRPAT
—
0.27
9
—
0.279
—
0.279
—
0.279
UI
GIGE Receiver Jitter Tolerance (6)
Deterministic
jitter tolerance
(peak-to-peak)
Pattern = CJPAT
> 0.4
UI
Combined
deterministic and
random jitter
tolerance
(peak-to-peak)
Pattern = CJPAT
> 0.66
UI
HiGig Transmit Jitter Generation (7)
Deterministic
jitter
(peak-to-peak)
Data rate =
3.75 Gbps
Pattern = CJPAT
—
0.17
—
0.17
—
UI
Total jitter
(peak-to-peak)
Data rate =
3.75 Gbps
Pattern = CJPAT
—
0.35
—
0.35
—
UI
HiGig Receiver Jitter Tolerance (7)
Deterministic
jitter tolerance
(peak-to-peak)
Data rate =
3.75 Gbps
Pattern = CJPAT
> 0.37
—
UI
Combined
deterministic and
random jitter
tolerance
(peak-to-peak)
Data rate =
3.75 Gbps
Pattern = CJPAT
> 0.65
—
UI
Sinusoidal jitter
tolerance
(peak-to-peak)
Jitter frequency =
22.1 KHz
Data rate =
3.75 Gbps
Pattern = CJPAT
> 8.5
—
UI
Jitter frequency =
1.875MHz
Data rate =
3.75 Gbps
Pattern = CJPAT
> 0.1
—
UI
Jitter frequency =
20 MHz
Data rate =
3.75 Gbps
Pattern = CJPAT
> 0.1
—
UI
Table 1–40. Transceiver Block Jitter Specifications for Arria II GX Devices (Note 1) (Part 4 of 10)
Symbol/
Description
Conditions
I3
C4
C5, I5
C6
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
相關PDF資料
PDF描述
VE-24W-CY-S CONVERTER MOD DC/DC 5.5V 50W
TAJC685K035H CAP TANT 6.8UF 35V 10% 2312
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TACL105K010R CAP TANT 1UF 10V 10% 0603
EP1AGX50DF1152C6N IC ARRIA GX FPGA 50K 1152FBGA
相關代理商/技術參數(shù)
參數(shù)描述
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