參數資料
| 型號： | EPM7512BFC256-5 |
| 廠商： | Altera |
| 文件頁數： | 27/66頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAX 7000 CPLD 512 256-FBGA |
| 標準包裝： | 90 |
| 系列： | MAX® 7000B |
| 可編程類型： | 系統(tǒng)內可編程 |
| 最大延遲時間 tpd(1)： | 5.5ns |
| 電壓電源 - 內部： | 2.375 V ~ 2.625 V |
| 邏輯元件/邏輯塊數目： | 32 |
| 宏單元數： | 512 |
| 門數： | 10000 |
| 輸入/輸出數： | 212 |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 256-BGA |
| 供應商設備封裝： | 256-FBGA（17x17） |
| 包裝： | 托盤 |
| 其它名稱： | 544-2361 |
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Altera Corporation
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MAX 7000B Programmable Logic Device Data Sheet
Timing Model
MAX 7000B device timing can be analyzed with the Altera software, with
a variety of popular industry-standard EDA simulators and timing
analyzers, or with the timing model shown in Figure 13. MAX 7000B
devices have predictable internal delays that enable the designer to
determine the worst-case timing of any design. The Altera software
provides timing simulation, point-to-point delay prediction, and detailed
timing analysis for device-wide performance evaluation.
Figure 13. MAX 7000B Timing Model
The timing characteristics of any signal path can be derived from the
timing model and parameters of a particular device. External timing
parameters, which represent pin-to-pin timing delays, can be calculated
as the sum of internal parameters. Figure 14 shows the timing relationship
between internal and external delay parameters.
f See Application Note 94 (Understanding MAX 7000 Timing) for more
information.
Logic Array
Delay
t LAD
Output
Delay
t OD3
t OD2
t OD1
t XZ
Z
t X1
t ZX2
t ZX3
Input
Delay
t IN
Register
Delay
t SU
t H
t PRE
t CLR
t RD
t COMB
t FSU
t FH
PIA
Delay
t PIA
Shared
Expander Delay
t SEXP
Register
Control Delay
t LAC
t IC
t EN
I/O
Delay
t IO
Global Control
Delay
t GLOB
Internal Output
Enable Delay
t IOE
Parallel
Expander Delay
t PEXP
Fast
Input Delay
t FIN
t FIND
+
相關PDF資料 |
PDF描述 |
|---|---|
| EPM9560RI240-20 | IC MAX 9000 CPLD 560 240-RQFP |
| ET80960JT10016 | IC MPU I960JT 3V 100MHZ 132-QFP |
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| EXPANDIO-USB-FS-DIL-28 | IC I/O EXPANDER USB 21B 28DIP |
| FIN1001M5 | IC DRIVER 3.3V LVDS HS SOT-23 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| EPM7512BFC256-5N | 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 512 Macro 212 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| EPM7512BFC256-7 | 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 512 Macro 212 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| EPM7512BFC256-7N | 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 512 Macro 212 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| EPM7512BFI256-10 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述: |
| EPM7512BFI256-7 | 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 7000 512 Macro 212 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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