Note: (1) EPM7032B, EPM70" />
參數(shù)資料
型號： EPM7512BFC256-5
廠商： Altera
文件頁數(shù)： 5/66頁
文件大?。?/td> 0K
描述： IC MAX 7000 CPLD 512 256-FBGA
標(biāo)準(zhǔn)包裝： 90
系列： MAX® 7000B
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1)： 5.5ns
電壓電源 - 內(nèi)部： 2.375 V ~ 2.625 V
邏輯元件/邏輯塊數(shù)目： 32
宏單元數(shù)： 512
門數(shù)： 10000
輸入/輸出數(shù)： 212
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 256-BGA
供應(yīng)商設(shè)備封裝： 256-FBGA（17x17）
包裝： 托盤
其它名稱： 544-2361
Altera Corporation
13
MAX 7000B Programmable Logic Device Data Sheet
Figure 6. I/O Control Block of MAX 7000B Devices
Note:
(1)
EPM7032B, EPM7064B, EPM7128B, and EPM7256B devices have six output enable signals. EPM7512B devices have
ten output enable signals.
When the tri-state buffer control is connected to ground, the output is
tri-stated (high impedance) and the I/O pin can be used as a dedicated
input. When the tri-state buffer control is connected to VCC, the output is
enabled.
The MAX 7000B architecture provides dual I/O feedback, in which
macrocell and pin feedbacks are independent. When an I/O pin is
configured as an input, the associated macrocell can be used for buried
logic.
from
Macrocell
Fast Input to
Macrocell
Register
Slew-Rate Control
I/O Standards
to PIA
to Other I/O Pins
6 or 10 Global
Output Enable Signals (1)
PIA
VCC
Open-Drain Output
OE Select Multiplexer
GND
Programmable Delay
Bus Hold
Programmable
Ground
Programmable
Pull-up
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PDF描述
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