參數資料
型號： EVAL-AD9832SDZ
廠商： Analog Devices Inc
文件頁數： 9/28頁
文件大小： 0K
描述： BOARD EVAL FOR AD9832
標準包裝： 1
系列： *
Data Sheet
AD9832
Rev. E | Page 17 of 28
SELECT DATA SOURCES
SET FSELECT
SET PSEL0, PSEL1
INITIALIZATION
WAIT 6 MCLK CYCLES (8 MCLK CYCLES IF SYNC = 1)
DAC OUTPUT
VOUT = VREFIN × 6.25 × ROUT/RSET × (1 + SIN(2π(FREG × fMCLK × t/232 + PHASEREG/212)))
CHANGE PHASE?
NO
CHANGE
fOUT?
CHANGE
fOUT?
YES
NO
YES
NO
YES
CHANGE FSELECT
CHANGE PHASEREG?
NO
YES
CHANGE PSEL0, PSEL1
DATA WRITE
FREG[0] =
fOUT0/fMCLK × 232
FREG[1] =
fOUT1/fMCLK × 232
PHASEREG [3:0] = DELTA PHASE[0, 1, 2, 3]
09090-
024
Figure 24. Flowchart for the AD9832 Initialization and Operation
INITIALIZATION
CONTROL REGISTER WRITE
SET SLEEP
RESET = 1
CLR = 1
SET SYNC AND/OR SELSRC TO 1
YES
NO
CONTROL REGISTER WRITE
SYNC = 1
AND/OR
SELSRC = 1
SET PINS OR FREQUENCY/PHASE REGISTER WRITE
SET FSELECT, PSEL0 AND PSEL1
CONTROL REGISTER WRITE
SLEEP = 0
RESET = 0
CLR = 0
WRITE INITIAL DATA
FREG[0] =
fOUT0/fMCLK × 232
FREG[1] =
fOUT1/fMCLK × 232
PHASEREG[3:0] = DELTA PHASE[0, 1, 2, 3]
09090-
025
Figure 25. Initialization
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