參數(shù)資料
型號： FW802C-DB
英文描述： FW 802C LOW - POWER IEEE 1394A-2000 TWO CABLE TRANSCEIVER/ ARBITER DEVICE
中文描述： 防火墻802C低-動力IEEE 1394A端口- 2000兩艘電纜收發(fā)器/仲裁器裝置
文件頁數(shù)： 5/24頁
文件大小： 301K
代理商： FW802C-DB
Data Sheet, Rev. 1
August 2002
FW802C Low-Power PHY IEEE1394A-2000
Two-Cable Transceiver/Arbiter Device
Agere Systems Inc.
5
Description
(continued)
to become active in order to respond to the event or to
notify the LLC of the event (e.g., incoming bias or dis-
connection is detected on a suspended port, a new
connection is detected on a nondisabled port, etc.).
The SYSCLK output will become active (and the PHY/
link interface will be initialized and become operative)
within 3 ms after LPS is asserted high, when the
FW802C is in the low-power mode.
Two of the signals are used to set up various test
conditions used in manufacturing. These signals (SE
and SM) should be connected to V
SS
for normal
operation.
5-5459.f (F)
Figure 1. Block Diagram
LINK
INTERFACE
I/O
RECEIVED
DATA
DECODER/
RETIMER
ARBITRATION
AND
CONTROL
STATE
MACHINE
LOGIC
BIAS
VOLTAGE
AND
CURRENT
GENERATOR
CABLE PORT 1
OCRYSTAL
PLL SYSTEM,
AND
CLOCK
GENERATOR
TRANSMIT
DATA
ENCODER
CABLE PORT 0
TPA0+
TPA0–
TPB0+
TPB0–
TPBIAS0
TPBIAS1
TPB1+
TPB1–
TPA1+
TPA1–
XI
XO
CPS
LPS
/ISO
CNA
SYSCLK
LREQ
CTL0
CTL1
D0
D1
D2
D3
D4
D5
D6
D7
C/LKON
SE
SM
PD
/RESET
R0
R1
相關(guān)PDF資料
PDF描述
FW803-09-DB PHY IEEE 1394A Three-Cable Transceiver/Arbiter Device
FW803 PHY IEEE 1394A Three-Cable Transceiver/Arbiter Device
FW804-09-DB PHY IEEE 1394A Four-Cable Transceiver/Arbiter Device
FW804 PHY IEEE 1394A Four-Cable Transceiver/Arbiter Device
FW80960RP-33 I/O Controller
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
FW803 制造商:AGERE 制造商全稱:AGERE 功能描述:PHY IEEE 1394A Three-Cable Transceiver/Arbiter Device
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