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參數(shù)資料
| 型號： | HC05H12GRS |
| 英文描述： | 68HC(7)05H12 General Release Specification |
| 中文描述： | 68HC（7）05H12總發(fā)行規(guī)格 |
| 文件頁數(shù)： | 112/196頁 |
| 文件大?。?/td> | 1289K |
| 代理商： | HC05H12GRS |
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L
G
R
16-Bit Timers
General Release Specification
MC68HC(7)05H12
—
Rev. 1.0
110
16-Bit Timers
MOTOROLA
IEDG2 — Capture on Negative/Positive Edge
1 = Capture on positive edge
0 = Capture on negative edge
An interrupt can also accompany a capture provided the corresponding
interrupt enable bit, ICI2E is set.
The result obtained by an input capture will be one more than the value
of the free-running counter on the rising edge of the internal bus clock
preceding the external transition. This delay is required for internal
synchronization. Resolution is one count of the free-running counter,
which is four internal bus clock cycles.
The free-running counter contents are transferred to the input capture
register on each proper signal transition regardless of whether the input
capture flag (IC2F) is set or clear. The input capture register always
contains the free-running counter value that corresponds to the most
recent input capture.
After a read of the input capture register most significant byte ($24), the
counter transfer is inhibited until the least significant byte ($25) is also
read. This characteristic causes the time used in the input capture
software routine and its interaction with the main program to determine
the minimum pulse period.
A read of the input capture register LSB ($25) does not inhibit the free-
running counter transfer since they occur on opposite edges of the
internal bus clock.
9.3.8 Timer Control Register 1
$002C
Bit 7
6
5
4
3
2
1
Bit 0
Read:
ICI1E
ICI2E
OCI1E
TOIE
CO1E
IEDG1
IEDG2
OLVL1
Write:
Reset:
0
0
0
0
0
U
U
0
Figure 9-3. Timer Control Register 1 (TCR1)
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關PDF資料 |
PDF描述 |
|---|---|
| HC05J5AGRS | 68HC(7)05J5A General Release Specification |
| HC05J5GRS | 68HC05J5 General Release Specification |
| HC05JB3GRS | 68HC05JB3 and 68HC705JB3 General Release Specification |
| HC05JB4GRS | 68HC(7)05JB4 General Release Specification |
| HC05JJ6GRS | 68HC05JJ6 and 68HC05JP6 General Release Specification |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| HC05J5AGRS | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:68HC(7)05J5A General Release Specification |
| HC05J5GRS | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:68HC05J5 General Release Specification |
| HC05JB3GRS | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:68HC05JB3 and 68HC705JB3 General Release Specification |
| HC05JB4GRS | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:68HC(7)05JB4 General Release Specification |
| HC05JJ6GRS | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:68HC05JJ6 and 68HC05JP6 General Release Specification |
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