參數(shù)資料
型號: HC05H12GRS
英文描述: 68HC(7)05H12 General Release Specification
中文描述: 68HC(7)05H12總發(fā)行規(guī)格
文件頁數(shù): 44/196頁
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代理商: HC05H12GRS
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L
G
R
CPU and Instruction Set
General Release Specification
MC68HC(7)05H12
Rev. 1.0
42
CPU and Instruction Set
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MOTOROLA
3.4 Arithmetic/Logic Unit (ALU)
The ALU performs the arithmetic and logical operations defined by the
instruction set.
The binary arithmetic circuits decode instructions and set up the ALU for
the selected operation. Most binary arithmetic is based on the addition
algorithm, carrying out subtraction as negative addition. Multiplication is
not performed as a discrete operation but as a chain of addition and shift
operations within the ALU. The multiply instruction (MUL) requires 11
internal clock cycles to complete this chain of operations.
3.5 Instruction Set Overview
The MCU instruction set has 62 instructions and uses eight addressing
modes. The instructions include all those of the M146805 CMOS Family
plus one more: the unsigned multiply (MUL) instruction. The MUL
instruction allows unsigned multiplication of the contents of the
accumulator (A) and the index register (X). The high-order product is
stored in the index register, and the low-order product is stored in the
accumulator.
3.6 Addressing Modes
The CPU uses eight addressing modes for flexibility in accessing data.
The addressing modes provide eight different ways for the CPU to find
the data required to execute an instruction. The eight addressing modes
are:
Inherent
Immediate
Direct
Extended
Indexed, no offset
Indexed, 8-bit offset
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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