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參數資料
| 型號： | HC908JB8AD |
| 英文描述： | Addendum to MC68HC908JB8 Technical Data Rev. 2.0 |
| 中文描述： | 增編MC68HC908JB8的技術數據牧師2.0 |
| 文件頁數： | 383/586頁 |
| 文件大?。?/td> | 3136K |
| 代理商： | HC908JB8AD |
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MC68HC08AZ32 Emulator Input/Output Ports
Port E
MC68HC908AT32
—
Rev. 2.0
General Release Specification
MOTOROLA
MC68HC08AZ32 Emulator Input/Output Ports
For More Information On This Product,
Go to: www.freescale.com
383
L
G
R
MISO — Master In/Slave Out Bit
The PTE5/MISO pin is the master in/slave out terminal of the SPI
module. When the SPI enable bit, SPE, is clear, the SPI module is
disabled, and the PTE5/MISO pin is available for general-purpose
I/O. (See
17.14.1 SPI Control Register
.)
SS — Slave Select Bit
The PTE4/SS pin is the slave select input of the SPI module. When
the SPE bit is clear, or when the SPI master bit, SPMSTR, is set and
MODFEN bit is low, the PTE4/SS pin is available for general-purpose
I/O. (See
17.13.4 SS (Slave Select)
.) When the SPI is enabled as a
slave, the DDRF0 bit in data direction register E (DDRE) has no effect
on the PTE4/SS pin.
NOTE:
Data direction register E (DDRE) does not affect the data direction of
port E pins that are being used by the SPI module. However, the DDRE
bits always determine whether reading port E returns the states of the
latches or the states of the pins. (See
Table 22-6
.)
TACH[1:0] — Timer Channel I/O Bits
The PTE3/TACH1–PTE2/TACH0 pins are the TIM input
capture/output compare pins. The edge/level select bits,
ELSxB:ELSxA, determine whether the PTE3/TACH1–PTE2/TACH0
pins are timer channel I/O pins or general-purpose I/O pins. (See
18.9.4 TIMA Channel Status and Control Registers
.)
NOTE:
Data direction register E (DDRE) does not affect the data direction of
port E pins that are being used by the TIM. However, the DDRE bits
always determine whether reading port E returns the states of the
latches or the states of the pins. (See
Table 22-6
.)
RxD — SCI Receive Data Input Bit
The PTE1/RxD pin is the receive data input for the SCI module. When
the enable SCI bit, ENSCI, is clear, the SCI module is disabled, and
the PTE1/RxD pin is available for general-purpose I/O. (See
16.9.1
SCI Control Register 1
.)
F
Freescale Semiconductor, Inc.
n
.
相關PDF資料 |
PDF描述 |
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| HC908LD64AD | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Addendum to MC68HC908LD64 Technical Data Rev. 2.0 |
| HC908LJ12AD | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Addendum to MC68HC908LJ12 Technical Data Rev. 2.0 |
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