參數(shù)資料
型號： HC908JB8AD
英文描述： Addendum to MC68HC908JB8 Technical Data Rev. 2.0
中文描述： 增編MC68HC908JB8的技術(shù)數(shù)據(jù)牧師2.0
文件頁數(shù)： 568/586頁
文件大小： 3136K
代理商： HC908JB8AD
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L
G
R
Electrical Specifications
General Release Specification
MC68HC908AT32
—
Rev. 2.0
568
Electrical Specifications
For More Information On This Product,
Go to: www.freescale.com
MOTOROLA
29.5 5.0 Volt DC Electrical Characteristics
Characteristic
Symbol
Min
Typ
Max
Unit
Output High Voltage
(I
Load
= –2.0 mA) All Ports
Output Low Voltage
(I
Load
= 1.6 mA) All Ports
Input High Voltage
All Ports, IRQ
s
, RESET, OSC1
V
OH
V
DD
–0.8
—
—
V
V
OL
—
—
0.4
V
V
IH
0.7 x V
DD
—
V
DD
V
Input Low Voltage
All Ports, IRQ
s
, RESET, OSC1
V
IL
V
SS
—
0.3 x V
DD
V
V
DD
+ V
DDA
Supply Current
Run (see Note 3)
Wait (see Note 4)
Stop (see Note 5)
25
°
C
–40
°
C to +125
°
C
25
°
C with LVI Enabled
–40
°
C to +125
°
C with LVI Enabled
I
DD
—
—
—
—
—
—
—
—
—
—
—
—
30
15
5
50
400
500
mA
mA
μ
A
μ
A
μ
A
μ
A
μ
A
μ
A
I/O Ports Hi-Z Leakage Current
I
L
I
IN
—
—
±
1
±
1
Input Current
—
—
Capacitance
Ports (As Input or Output)
C
OUT
C
IN
V
LVII
H
LVI
V
POR
V
PORRST
R
POR
V
HI
—
—
—
—
12
8
pF
Low-Voltage Reset Inhibit
—
4.2
—
V
Low-Voltage Reset Inhibit/Recover Hysteresis
—
200
—
mV
POR ReArm Voltage (see Note 6)
0
—
200
mV
POR Reset Voltage (see Note 7)
0
—
800
mV
POR Rise Time Ramp Rate (see Note 8)
0.02
—
—
V/ms
High COP Disable Voltage (see Note 9)
V
DD
V
DD
+ 2
V
NOTES:
1.
2.
3.
V
DD
= 5.0 Vdc
±
10%, V
SS
= 0 Vdc, T
= –40
°
C to +125
°
C, unless otherwise noted.
Typical values reflect average measurements at midpoint of voltage range, 25
°
C only.
Run (Operating) I
DD
measured using external square wave clock source (f
OP
= 8.4 MHz). All inputs 0.2 V from rail.
No dc loads. Less than 100 pF on all outputs. C
L
= 20 pF on OSC2. All ports configured as inputs. OSC2 capaci-
tance linearly affects run I
DD
. Measured with all modules enabled.
Wait I
DD
measured using external square wave clock source (f
OP
= 8.4 MHz). All inputs 0.2 Vdc from rail. No dc
loads. Less than 100 pF on all outputs, C
L
= 20 pF on OSC2. All ports configured as inputs. OSC2 capacitance
linearly affects wait I
DD
. Measured with all modules enabled.
Stop I
DD
measured with OSC1 = V
SS
.
Maximum is highest voltage that POR is guaranteed.
Maximum is highest voltage that POR is possible.
If minimum V
DD
is not reached before the internal POR reset is released, RST must be driven low externally until
minimum V
DD
is reached.
See
13.9 COP Module During Break Interrupts
.
4.
5.
6.
7.
8.
9.
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料
PDF描述
HC908JL3AD Addendum to MC68HC908JL3 Technical Data Rev. 1.0
HC908JL8AD Addendum to MC68HC908JL8 Technical Data Rev. 2.0
HC908LD64AD Addendum to MC68HC908LD64 Technical Data Rev. 2.0
HC908LJ12AD Addendum to MC68HC908LJ12 Technical Data Rev. 2.0
HC9P5504B-5X96 Subscriber Line Interface Circuit
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參數(shù)描述
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HC908JL8D 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Addendum to MC68HC908JL8 Technical Data
HC908LD64AD 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Addendum to MC68HC908LD64 Technical Data Rev. 2.0
HC908LJ12AD 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Addendum to MC68HC908LJ12 Technical Data Rev. 2.0
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