參數(shù)資料
型號(hào)： HSP50214AVC
廠商： HARRIS SEMICONDUCTOR
元件分類： 通信及網(wǎng)絡(luò)
英文描述： Programmable Downconverter
中文描述： SPECIALTY TELECOM CIRCUIT, PQFP120
文件頁數(shù)： 40/60頁
文件大?。?/td> 467K
代理商： HSP50214AVC
40
TIMING
|r|
φ
Q
DUAL
PORT
RAM
16
ADDRESS
SEQUENCER
INCR
WR
“SET OF WORDS”
16
16
16
D
D
16
I
RD
INCR
WRITE
SEQUENCER
|r|
φ
Q
I
STATUS
0
1
2
3
4
NEW
DATA
M
FIGURE 41. 8-BIT MICROPROCESSOR INTERFACE BUFFER RAM MODE BLOCK DIAGRAM
OUTPUT
DATA
0
1
0
1
0
1
0
1
WRITE
ADDRESS “5”
CONTROL
WORD 23
R0
R1
R2
A0
A1
R0 A1
LSByte
MSByte
2
3
INT(15:0)
INT(22:16)
AGC
A(2:0)
RD
R2, R1, R0
0: I;Q
1: |r|;
φ
2:
4: INPUT AGC
5: AGC; TIMING
M
M
M
M
M
A2, A1, A0
A1
A2
A0
R2 R1 R0 A2 A1 A0 SELECTION
0
0
0
0
0
0
0
0
0
0
0
0
0
0
1
0
0
0
0
1
0
0
1
0
0
0
0
1
0
0
0
0
1
0
1
0
0
1
0
1
0
1
0
0
0
0
1
0
0
0
0
1
1
X
X
1
0
0
0
0
1
0
0
0
0
1
0
0
0
1
1
0
1
0
0
1
0
1
0
0
1
0
1
0
1
1
0
1
0
1
1
1
X
X
X
X
X
X
1
1
0 RAM I LSB
1 RAM I MSB
0 RAM Q LSB
1 RAM Q MSB
0 RAM |r| LSB
1 RAM |r| MSB
0 RAM
φ
LSB
1 RAM
φ
MSB
0 RAM
LSB
1 RAM
MSB
X NOT USED
0 INPUT INTEG LSB
1 INPUT INTEG NMSB
0 INPUT INTEG MSB
0 AGC LSB
1 AGC MSB
0 TIMING LSB
1 TIMING MSB
X NOT USED
1 STATUS
FIGURE 42. RAM LOAD SEQUENCE
PROCCLK
DATARDY
(I/Q SELECTED)
DATARDY
(R/
φ
SELECTED)
INTRRPT
WRITES TO
SNAPSHOT
RAM
I/Q
R/
φ
I
Q
R
φ
DELAY TO DATARDY DEPENDS ON LENGTH OF FIR IF FREQ CHOSEN
HSP50214A
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