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參數(shù)資料
| 型號： | ICS1894KI-40LFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 15/53頁 |
| 文件大?。?/td> | 0K |
| 描述： | PHYCEIVER LOW PWR 3.3V 40QFN |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | PHYceiver™ |
| 類型： | PHY 收發(fā)器 |
| 規(guī)程： | MII，RMII |
| 電源電壓： | 3.14 V ~ 3.47 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 40-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 40-VFQFPN（6x6） |
| 包裝： | 標(biāo)準(zhǔn)包裝 |
| 其它名稱： | 800-2032-6 |
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ICS1894-40
10BASE-T/100BASE-TX INTEGRATED PHYCEIVER WITH RMII INTERFACE
PHYCEIVER
IDT 10BASE-T/100BASE-TX INTEGRATED PHYCEIVER WITH RMII INTERFACE
22
ICS1894-40
REV K 022412
8.3
Message code field
/Unformatted code field
Bit value depends on the
particular message
Bit value depends on the
particular message
RO
–
0
8.2
Message code field
/Unformatted code field
Bit value depends on the
particular message
Bit value depends on the
particular message
RO
–
0
8.1
Message code field
/Unformatted code field
Bit value depends on the
particular message
Bit value depends on the
particular message
RO
–
0
8.0
Message code field
/Unformatted code field
Bit value depends on the
particular message
Bit value depends on the
particular message
RO
–
0
Register
9 through 15 - Reserved by IEEE
Register
16 - Extended Control Register
16.15
Command Override
Write enable
Disabled
Enabled
RW
SC
0
–
16.14
ICS reserved
Reserved
RW/0
–
0
16.13
ICS reserved
Reserved
RW/0
–
0
16.12
ICS reserved
Reserved
RW/0
–
0
16.11
ICS reserved
Reserved
RW/0
–
0
–
16.10
PHY Address Bit 4
RO
–
1
16.9
PHY Address Bit 3
RO
–
L
16.8
PHY Address Bit 2
RO
–
L
16.7
PHY Address Bit 1
RO
–
L
–
16.6
PHY Address Bit 0
RO
–
L
16.5
Stream Cipher Test
Mode
Normal operation
Test mode
RW
–
0
16.4
ICS reserved
Read unspecified
RW/0
–
16.3
NRZ/NRZI encoding
NRZ encoding
NRZI encoding
RW
–
1
8
16.2
Transmit invalid codes
Disabled
Enabled
RW
–
0
16.1
ICS reserved
Read unspecified
RW/0
–
0
16.0
Stream Cipher disable
Stream Cipher enabled
Stream Cipher disabled
RW
–
0
Register
17 - Quick Poll Detailed Status Register
17.15
Data rate
10 Mbps
100 Mbps
RO
–
17.14
Duplex
Half duplex
Full duplex
RO
–
Auto-Negotiation
Progress Monitor Bit 2
Reference Decode Table
RO
LM
X
0
17.12
Auto-Negotiation
Progress Monitor Bit 1
Reference Decode Table
RO
LM
X
0
Bit
Definition
When Bit = 0
When Bit = 1
Access 2
SF2
Default3
Hex
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ID82C55A | IC I/O EXPANDER 24B 40DIP |
| ID82C82 | IC DRIVER BUS OCT LATCHING 20DIP |
| ID82C86H | IC TRANSCEIVER OCT BUS 20-DIP |
| IDT5V5201DCGI | TXRX 1CH M-LVDS TO LVTTL 8-SOIC |
| IDT5V5206DCGI | TXRX 1CH M-LVDS TO LVTTL 8-SOIC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ICS1894KI-43LFT | 制造商:Integrated Device Technology Inc 功能描述:PHYCEIVER LOW PWR 3.3V 40QFN |
| ICS200 | 制造商:ICS 制造商全稱:ICS 功能描述:SMPTE Time Code Receiver/Generator |
| ICS2001M | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Digital-to-Analog Converter |
| ICS2001N | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Digital-to-Analog Converter |
| ICS2002 | 制造商:ICS 制造商全稱:ICS 功能描述:Wavedec Digital Audio Codec |
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