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參數(shù)資料
| 型號(hào)： | ICSSSTUB32866B |
| 英文描述： | 25-Bit Configurable Registered Buffer for DDR2 |
| 中文描述： | 25位可配置的注冊(cè)緩沖DDR2內(nèi)存 |
| 文件頁(yè)數(shù)： | 2/28頁(yè) |
| 文件大?。?/td> | 554K |
| 代理商： | ICSSSTUB32866B |
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2
ICSSSTUB32866B
Advance Information
1165—10/25/06
Ball Assignments
Register A (C0 = 0, C1 = 1)
C0 = 0, C1 = 0
Register B (C0 = 1, C1 = 1)
25 bit 1:1 Register
14 bit 1:2 Registers
6
Q15
Q2
GND
GND
D15
D2
B
Q16
Q3
V
DD
V
DD
D16
D3
C
Q17
Q5
V
DD
V
DD
D17
D5
E
Q18
Q6
GND
GND
D18
D6
F
Q19
Q8
GND
GND
D19
D8
K
Q20
Q9
V
DD
V
DD
D20
D9
L
NC
QCS
DCS
QERR
CSR
CK
RST
GND
GND
CK
H
NC
QODT
GND
GND
DODT
D
NC
QCKE
V
DD
V
REF
PPO
DCKE
A
Q24
Q13
V
DD
V
DD
D24
D13
R
Q25
Q14
V
DD
V
REF
D25
D14
T
Z
OL
Z
OH
V
DD
V
DD
J
C0
C1
V
DD
V
DD
PAR_IN
G
Q21
Q10
GND
GND
D21
D10
M
Q22
Q11
V
DD
V
DD
D22
D11
N
Q23
Q12
GND
GND
D23
D12
P
5
4
3
2
1
6
Q2B
Q2A
GND
GND
NC
D2
B
Q3B
Q3A
V
DD
V
DD
NC
D3
C
Q5B
Q5A
V
DD
V
DD
NC
D5
E
Q6B
Q6A
GND
GND
NC
D6
F
Q8B
Q9B
QCSB
GND
GND
CK
H
QODTB
QODTA
GND
GND
DODT
D
QCKEB
QCKEA
V
DD
V
REF
PPO
DCKE
Q13B
Q14B
Z
OL
Z
OH
V
DD
V
DD
J
C0
C1
V
DD
V
DD
PAR_IN
G
Q10B
Q11B
Q12B
5
Q8A
Q9A
Q13A
Q14A
Q10A
Q11A
Q12A
4
V
DD
GND
V
DD
GND
V
DD
GND
V
DD
3
V
REF
GND
V
DD
GND
V
DD
GND
V
DD
2
NC
NC
NC
NC
NC
NC
NC
1
D8
D9
D10
D11
D12
D14
D13
A
K
L
M
N
P
R
T
QCSA
DCS
QERR
CSR
CK
RST
6
5
2
1
4
3
Q13B
Q13A
NC
D13
V
DD
V
DD
R
Q10B
Q10A
NC
D10
GND
GND
M
Q9B
Q9A
NC
D9
V
DD
V
DD
L
Q8B
Q8A
NC
D8
GND
GND
K
QCSB
QCSA
CK
GND
GND
H
Q6B
Q6A
NC
D6
GND
GND
F
Q5B
Q5A
NC
D5
V
DD
V
DD
E
Z
OL
Z
OH
V
DD
V
DD
J
QODTB
QODTA
NC
DODT
V
DD
V
DD
N
QCKEB
QCKEA
NC
DCKE
V
DD
V
REF
T
Q4B
Q4A
D4
GND
GND
D
Q3B
Q3A
NC
D3
V
DD
V
DD
C
Q2B
Q2A
NC
D2
GND
GND
B
Q1B
Q1A
PPO
D1
V
DD
V
REF
A
C0
C1
PAR_IN
V
DD
V
DD
G
Q12B
Q12A
NC
D12
GND
GND
P
DCS
QERR
CSR
CK
RST
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
|---|---|
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