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參數(shù)資料
| 型號： | ICSSSTUB32866Bz(LF)T |
| 英文描述： | 25-Bit Configurable Registered Buffer for DDR2 |
| 中文描述： | 25位可配置的注冊緩沖DDR2內(nèi)存 |
| 文件頁數(shù)： | 12/28頁 |
| 文件大小： | 554K |
| 代理商： | ICSSSTUB32866BZ(LF)T |
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12
ICSSSTUB32866B
Advance Information
1165—10/25/06
2. Device standard (cont'd)
CK
D1D25
RST
DCS
CSR
CK
Q1Q25
PAR_IN
PPO
QERR
tinact
tRPHL
RST to Q
tRPHL
RST to PPO
tRPLH
RST to QERR
H, L, or X
H or L
Figure 11 — Timing diagram for SSTU32866 used as a single device; C0=0, C1=0;
RST switches from H to L
After RST is switched from high to low, all data and clock unouts signals must be set and held at valid logic levels (not floating) for
a minimum time of INACT
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ICSSSTUB32871A | 27-Bit Registered Buffer for DDR2 |
| ICSSSTUB32871AzLFT | 27-Bit Registered Buffer for DDR2 |
| ICSSSTUB32871AzT | 27-Bit Registered Buffer for DDR2 |
| ICSSSTUB32872A | 28-Bit Registered Buffer for DDR2 |
| ICSSSTUBF32866A | 25-Bit Configurable Registered Buffer for DDR2 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ICSSSTUB32871A | 制造商:ICS 制造商全稱:ICS 功能描述:27-Bit Registered Buffer for DDR2 |
| ICSSSTUB32871AZLFT | 制造商:ICS 制造商全稱:ICS 功能描述:27-Bit Registered Buffer for DDR2 |
| ICSSSTUB32871AZT | 制造商:ICS 制造商全稱:ICS 功能描述:27-Bit Registered Buffer for DDR2 |
| ICSSSTUB32872A | 制造商:ICS 制造商全稱:ICS 功能描述:28-Bit Registered Buffer for DDR2 |
| ICSSSTUBF32866A | 制造商:ICS 制造商全稱:ICS 功能描述:25-Bit Configurable Registered Buffer for DDR2 |
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