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參數(shù)資料
| 型號： | IDT5T9820NLI8 |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 24/36頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK DRIVER ZD PLL 68-VFQFPN |
| 產(chǎn)品變化通告： | Product Discontinuation 05/Jan/2011 |
| 標準包裝： | 2,500 |
| 類型： | PLL 時鐘驅(qū)動器 |
| PLL： | 帶旁路 |
| 輸入： | eHSTL，HSTL，LVPECL，LVTTL |
| 輸出： | eHSTL，HSTL，LVTTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:10 |
| 差分 - 輸入:輸出： | 是/無 |
| 頻率 - 最大： | 250MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 68-VFQFPN（10x10） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 5T9820NLI8 |
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30
INDUSTRIALTEMPERATURERANGE
IDT5T9820
EEPROM PROGRAMMABLE 2.5V ZERO DELAY PLL CLOCK DRIVER
JTAG INTERFACE
Five additional pins (TDI, TDO, TMS, TCLK and TRST) are provided to
supporttheJTAGboundaryscaninterface.TheIDT5T9820 incorporatesthe
necessarytapcontrollerandmodifiedpadcellstoimplementtheJTAGfacility.
NotethatIDTprovidesappropriateBoundaryScanDescriptionLanguage
program files for these devices.
TEST ACCESS PORT (TAP)
The Tap interface is a general-purpose port that provides access to the
internaloftheprocessor.Itconsistsoffourinputports(TCLK,TMS,TDI,TRST)
and one output port (TDO).
TheStandardJTAGinterfaceconsistsoffourbasicelements:
Test Access Port (TAP)
TAP controller
Instruction Register (IR)
Data Register Port (DR)
The following sections provide a brief description of each element. For a
completedescriptionrefertotheIEEEStandardTestAccessPortSpecification
(IEEE Std. 1149.1-1990).
THE TAP CONTROLLER
The Tap controller is a synchronous finite state machine that responds to
TMSandTCLKsignalstogenerateclockandcontrolsignalstotheInstruction
and Data Registers for capture and update of data.
Boundary Scan Architecture
TDO
TDI
TMS
TCLK
TRST
TAP
Controller
Device ID Reg.
Boundary Scan Reg.
Bypass Reg.
MUX
Instruction Decode
Instruction Register
Control Signals
clkDR, ShiftDR
UpdateDR
clkLR, ShiftLR
UpdateLR
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PDF描述 |
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參數(shù)描述 |
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