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參數(shù)資料
| 型號： | IDT5T9820NLI8 |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 31/36頁 |
| 文件大小： | 0K |
| 描述： | IC CLK DRIVER ZD PLL 68-VFQFPN |
| 產(chǎn)品變化通告： | Product Discontinuation 05/Jan/2011 |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 類型： | PLL 時鐘驅(qū)動器 |
| PLL： | 帶旁路 |
| 輸入： | eHSTL，HSTL，LVPECL，LVTTL |
| 輸出： | eHSTL，HSTL，LVTTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:10 |
| 差分 - 輸入:輸出： | 是/無 |
| 頻率 - 最大： | 250MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 68-VFQFPN（10x10） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 5T9820NLI8 |
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4
INDUSTRIALTEMPERATURERANGE
IDT5T9820
EEPROM PROGRAMMABLE 2.5V ZERO DELAY PLL CLOCK DRIVER
NOTE:
1. Capacitance applies to all inputs except JTAG/I2C signals, SEL, ADDR0, and ADDR1.
CAPACITANCE(TA=+25°C,f=1MHz,VIN=0V)
Parameter
Description
Min.
Typ.
Max.
Unit
CIN
InputCapacitance
2.5
3
3.5
pF
COUT
OutputCapacitance
—
6.3
7
pF
Symbol
Description
Max
Unit
VDDQN, VDD Power Supply Voltage(2)
–0.5 to +3.6
V
VI
Input Voltage
–0.5 to +3.6
V
VO
Output Voltage
–0.5 to VDDQ +0.5
V
VREF
Reference Voltage(3)
–0.5 to +3.6
V
TJ
Junction Temperature
150
°C
TSTG
Storage Temperature
–65 to +165
°C
ABSOLUTE MAXIMUM RATINGS(1)
NOTES:
1. Stresses greater than those listed under ABSOLUTE MAXIMUM RATINGS may cause
permanent damage to the device. This is a stress rating only and functional operation
of the device at these or any other conditions above those indicated in the operational
sections of this specification is not implied. Exposure to absolute maximum rating
conditions for extended periods may affect reliability.
2. VDDQN and VDD internally operate independently. No power sequencing requirements
need to be met.
3. Not to exceed 3.6V.
Symbol
Description
Min.
Typ.
Max.
Unit
TA
AmbientOperatingTemperature
–40
+25
+85
°C
VDD(1)
InternalPowerSupplyVoltage
2.3
2.5
2.7
V
HSTL Output Power Supply Voltage
1.4
1.5
1.6
V
VDDQN(1)
Extended HSTL and 1.8V LVTTL Output Power Supply Voltage
1.65
1.8
1.95
V
2.5V LVTTL Output Power Supply Voltage
VDD
V
VT
TerminationVoltage
VDDQN / 2
V
RECOMMENDED OPERATING RANGE
NOTE:
1. Inputs are capable of translating the following interface standards. User can select between:
Single-ended 2.5V LVTTL levels
Single-ended 1.8V LVTTL levels
or
Differential 2.5V/1.8V LVTTL levels
Differential HSTL and eHSTL levels
Differential LVEPECL levels
PIN DESCRIPTION
Symbol
I/O
Type
Description
REF[1:0]
I
Adjustable(1)
Clock input. REF[1:0] is the "true" side of the differential clock input. If operating in single-ended mode, REF[1:0] is the clock input.
REF[1:0]
/
I
Adjustable(1)
Complementaryclockinput. REF[1:0]/VREF[1:0] isthe"complementary"sideofREF[1:0] iftheinputisindifferentialmode. Ifoperating
VREF[1:0]
insingle-endedmode,REF[1:0]/VREF[1:0]isleftfloating. Forsingle-endedoperationindifferentialmode,REF[1:0]/VREF[1:0]shouldbeset
tothedesiredtogglevoltageforREF[1:0]:
2.5VLVTTL
VREF =1250mV(SSTL2compatible)
1.8V LVTTL, eHSTL
VREF = 900mV
HSTL
VREF = 750mV
LVEPECL
VREF = 1082mV
FB
I
Adjustable(1)
Clockinput. FBisthe"true"sideofthedifferentialfeedbackclockinput. Ifoperatinginsingle-endedmode,FBisthefeedbackclockinput.
FB/VREF2
I
Adjustable(1)
Complementaryfeedbackclockinput. FB/VREF2isthe"complementary"sideofFBiftheinputisindifferentialmode. Ifoperatinginsingle-
endedmode,FB/VREF2isleftfloating. Forsingle-endedoperationindifferentialmode, FB/VREF2shouldbesettothedesiredtogglevoltage
for FB:
2.5VLVTTL
VREF =1250mV(SSTL2compatible)
1.8V LVTTL, eHSTL
VREF = 900mV
HSTL
VREF = 750mV
LVEPECL
VREF = 1082mV
NOTE:
1. All power supplies should operate in tandem. If VDD or VDDQN is at maximum, then VDDQN or VDD (respectively) should be at maximum, and vice-versa.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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