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參數(shù)資料
| 型號： | IDT5T9820NLI8 |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 28/36頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK DRIVER ZD PLL 68-VFQFPN |
| 產(chǎn)品變化通告： | Product Discontinuation 05/Jan/2011 |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 類型： | PLL 時鐘驅(qū)動器 |
| PLL： | 帶旁路 |
| 輸入： | eHSTL，HSTL，LVPECL，LVTTL |
| 輸出： | eHSTL，HSTL，LVTTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:10 |
| 差分 - 輸入:輸出： | 是/無 |
| 頻率 - 最大： | 250MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 68-VFQFPN（10x10） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 5T9820NLI8 |
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34
INDUSTRIALTEMPERATURERANGE
IDT5T9820
EEPROM PROGRAMMABLE 2.5V ZERO DELAY PLL CLOCK DRIVER
JTAG
AC ELECTRICAL CHARACTERISTICS
Symbol
Parameter
Min.
Max.
Units
tTCLK
JTAG Clock Input Period
100
—
ns
tTCLKHIGH
JTAG Clock HIGH
40
—
ns
tTCLKLOW
JTAG Clock Low
40
—
ns
tTCLKRISE
JTAG Clock Rise Time
—
5(1)
ns
tTCLKFALL
JTAG Clock Fall Time
—
5(1)
ns
tRST
JTAG Reset
50
—
ns
tRSR
JTAG Reset Recovery
50
—
ns
NOTE:
1. Guaranteed by design.
Standard JTAG Timing
NOTE:
t1 = tTCLKLOW
t2 = tTCLKHIGH
t3 = tTCLKFALL
t4 = tTCLKRISE
t5 = tRST (reset pulse width)
t6 = tRSR (reset recovery)
TCLK
TDI/TMS
TDO
TRST
tTCLK
t1
t2
t3
t4
t5
t6
tDS
tDH
tDO
TDO
SYSTEMINTERFACEPARAMETERS
Symbol
Parameter
Min.
Max.
Units
tDO
DataOutput(1)
—20
ns
tDOH
Data Output Hold(1)
0—
ns
tDS
Data Input, tRISE = 3ns
10
—
ns
tDH
Data Input, tFALL = 3ns
10
—
ns
NOTE:
1. 50pF loading on external output signals.
PROGRAMMINGNOTES
OncetheIDT5T9820hasbeenprogrammedeitherwithaProgWriteorProgRestoreinstruction,thedevicewillattempttoachievephaselockusingthenew
PLLconfiguration. IfthereisavalifREFandFBinputclockconnectedtothedevice,anditdoesnotachievelock,theusershouldissueaProgReadinstruction
to confirm that the PLL configuration data is valid.
Onpower-upandbeforetheautomaticProgRestoreinstructionhascompleted,theinternalprogrammingregisterswillcontainthevalueof'0'forallbits95:0.
ThePLLwillremainattheminimumfrequencyandwillnotachievephaselockuntilaftertheautomaticrestoreiscompleted. Iftheoutputsareenabledbythe
nSOE pins, the outputs will toggle at the minimum frequency. If the outputs are disabled by the nSOE pins, and the OMODE pin is set high, the nQ[1:0] and
QFB are stopped HIGH, while QFB is stopped LOW.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT5T9890NLI8 | IC CLK DRIVER 2.5V PLL 68-VFQFPN |
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參數(shù)描述 |
|---|---|
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