參數(shù)資料
型號(hào)： IDT5V49EE702NDGI
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 12/34頁(yè)
文件大?。?/td> 0K
描述： IC PLL CLK GEN 200MHZ 28VQFN
產(chǎn)品培訓(xùn)模塊： VersaClock™ III Programmable Clocks
特色產(chǎn)品： VersaClock III Timing Devices
標(biāo)準(zhǔn)包裝： 75
系列： VersaClock™ III
類(lèi)型： 時(shí)鐘發(fā)生器，多路復(fù)用器
PLL： 帶旁路
輸入： LVCMOS，LVTTL，晶體
輸出： HCSL，LVCMOS，LVDS，LVPECL，LVTTL
電路數(shù)： 1
比率 - 輸入:輸出： 2:7
差分 - 輸入:輸出： 無(wú)/是
頻率 - 最大： 500MHz
除法器/乘法器： 是/是
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 28-VFQFN 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝： 28-VFQFPN（4x4）
包裝： 管件
其它名稱： 800-1918
IDT5V49EE702DLGI
IDT5V49EE702
EEPROM PROGRAMMABLE CLOCK GENERATOR
CLOCK SYNTHESIZER
IDT EEPROM PROGRAMMABLE CLOCK GENERATOR
2
IDT5V49EE702
REV M 092412
Functional Block Diagram
1. OUT1 & OUT2, OUT3 & OUT6, and OUT5 & OUT5 pairs can be configured to be
LVDS, LVPECL or HCSL, or two single-ended LVTTL outputs.
2. CLKIN, CLKSEL, SD/OE and SEL[2:0] have pull down resistors.
PLL0 (SS)
PLL1
PLL2
PLL3 (SS)
/DIV2
/DIV1
/DIV3
/DIV6
/DIV5
XIN/REF
XOUT
CLKIN
CLKSEL
SDA
SCL
SEL[2:0]
OUT0
OUT1
OUT2
OUT3
OUT6
OUT5
SD/OE
S
R
C
0
S
R
C
1
S
R
C
2
S
R
C
3
S
R
C
6
S
R
C
5
Control
Logic
S1
S3
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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