參數(shù)資料
型號： IDT5V49EE702NDGI
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 24/34頁
文件大?。?/td> 0K
描述： IC PLL CLK GEN 200MHZ 28VQFN
產(chǎn)品培訓模塊： VersaClock™ III Programmable Clocks
特色產(chǎn)品： VersaClock III Timing Devices
標準包裝： 75
系列： VersaClock™ III
類型： 時鐘發(fā)生器，多路復用器
PLL： 帶旁路
輸入： LVCMOS，LVTTL，晶體
輸出： HCSL，LVCMOS，LVDS，LVPECL，LVTTL
電路數(shù)： 1
比率 - 輸入:輸出： 2:7
差分 - 輸入:輸出： 無/是
頻率 - 最大： 500MHz
除法器/乘法器： 是/是
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 28-VFQFN 裸露焊盤
供應商設備封裝： 28-VFQFPN（4x4）
包裝： 管件
其它名稱： 800-1918
IDT5V49EE702DLGI
IDT5V49EE702
EEPROM PROGRAMMABLE CLOCK GENERATOR
CLOCK SYNTHESIZER
IDT EEPROM PROGRAMMABLE CLOCK GENERATOR
30
IDT5V49EE702
REV M 092412
Default Configuration: OUT1 = Reference Clock output, all other outputs turned off.
1. Memory bytes do not exist. Readback will be last value in shift register. If reading sequentially, value in 0x51 will be
returned.
0xCA
49
SRC6[2:0]_CFG4
SRC5[2:0]_CFG4
Reserved
SRC6
000 - Reserved
001 - Reserved
010 - Reference input
011 - Reserved
100 - Reserved
101 - PLL1
110 - Reserved
111 - Reserved
Quiet MUX
0xCB
49
SRC6[2:0]_CFG5
SRC5[2:0]_CFG5
0xCC
49
SRC6[2:0]_CFG0
SRC5[2:0]_CFG0
0xCD
49
SRC6[2:0]_CFG1
SRC5[2:0]_CFG1
0xCE
49
SRC6[2:0]_CFG2
SRC5[2:0]_CFG2
0xCF
49
SRC6[2:0]_CFG3
SRC5[2:0]_CFG3
Addr
Default
Register
Hex
Value
Bit #
Description
76
5
4
3
2
1
0
相關PDF資料
PDF描述
IDT5V49EE502NLGI IC PLL CLK GEN 200MHZ 24VQFN
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參數(shù)描述
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