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參數(shù)資料
| 型號： | IDT72T54252L5BB |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | 2.5V QUAD/DUAL TeraSync⑩ DDR/SDR FIFO x10 QUAD FIFO or x10/x20 DUAL FIFO CONFIGURATIONS |
| 中文描述： | 64K X 20 OTHER FIFO, 3.6 ns, PBGA324 |
| 封裝： | 19 X 19 MM, 1 MM PITCH, PLASTIC, BGA-324 |
| 文件頁數(shù)： | 10/56頁 |
| 文件大小： | 555K |
| 代理商： | IDT72T54252L5BB |
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10
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72T54242/72T54252/72T54262 2.5V QUAD/DUAL TeraSync
DDR/SDR FIFO
32K x 10 x 4/16K x 20 x 2, 64K x 10 x 4/32K x 20 x 2 and 128K x 10 x 4/64K x 20 x 2
MARCH 22, 2005
SET-UP, CONFIGURATION & RESET PINS
Regardless of the mode of operation, (Quad or Dual), the following inputs
must be always be used. These inputs must be set-up with respect to master
reset as they are latched during this time.
WDDR – Write Port DDR/SDR selection
RDDR – Read Port DDR/SDR selection
MD – Mode Selection
OW – Output width
IW – Input Width
FSEL[1:0] – Flag offset default values
IOSEL – I/O Level Selection
PFM– Programmable Flag Mode
FWFT/SI – First word Fall Through or IDT Standard mode
QUAD MODE
The following inputs/ outputs should be used when Mux mode is selected
by the user:
INPUTS:
WCLK0, WCLK1, WCLK2, WCLK3 – Four write port clocks
WEN
0,
WEN
1,
WEN
2,
WEN
3 – Four write port enables
WCS
0,
WCS
1,
WCS
2,
WCS
3 – Four write port chip selects
RCLK0, RCLK1, RCLK2, RCLK3 – Four read port clocks
REN
0,
REN
1,
REN
2,
REN
3 – Four read port enables
RCS
0,
RCS
1,
RCS
2,
RCS
3, – Four read port chip selects
OE
0,
OE
1,
OE
2,
OE
3 – Four read port output enables
OUTPUTS:
ERCLK0, ERCLK1, ERCLK2, ERCLK3 – Four read port echo read clocks
EREN
0,
EREN
1,
EREN
2,
EREN
3 – Four read port echo read enables
EF
0/
OR
0,
EF
1/
OR
1,
EF
2/
OR
2,
EF
3/
OR
3 – Four read port Empty/Output
Ready Flags
FF
0/
IR
0,
FF
1/
IR
1,
FF
2/
IR
2,
FF
3/
IR
3 – Four write port full/ input ready flags
PAE
0,
PAE
1,
PAE
2,
PAE
3 – Four read port programmable almost empty flags
PAF
0,
PAF
1,
PAF
2,
PAF
3 – Four write port programmable almost empty flags
SERIAL PORT
The following pins are used when user programmng of the Programmable
Flag offsets is required:
SCLK – Serial Clock
SWEN
– Serial Write Enable
SREN
– Serial Read Enable
FWFT/SI – Serial Data In
SDO – Serial Data Out
DUAL MODE
The following inputs/ outputs should be used when Mux mode is selected
by the user:
INPUTS:
WCLK0, WCLK2 – Two write port clocks
WEN
0,
WEN
2 – Two write port enables
WCS
0,
WCS
2 – Two write port chip selects
RCLK0, RCLK2 – Two read port clocks
REN
0,
REN
2 – Two read port enables
RCS
0,
RCS
2 – Two read port chip selects
OE
0,
OE2
– Two read port output enables
OUTPUTS:
ERCLK0, ERCLK2 – Two read port echo read clock outputs
EREN
0,
EREN
2 – Two read port echo read enable outputs
EF
0/
OR
0,
EF
2/
OR
2 – Two read port empty/output ready flags
FF
0/
IR
0,
FF
2/
IR
2 – Two write port Full/ Input Ready Flags
PAE
0,
PAE
2 – Two read port programmable almost empty flags
PAF
0,
PAF
2 – Two write port programmable almost full flags
QUAD/DUAL I/O USAGE SUMMARY
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT72T54252L5BBI | 2.5V QUAD/DUAL TeraSync⑩ DDR/SDR FIFO x10 QUAD FIFO or x10/x20 DUAL FIFO CONFIGURATIONS |
| IDT72T54262 | 2.5V QUAD/DUAL TeraSync⑩ DDR/SDR FIFO x10 QUAD FIFO or x10/x20 DUAL FIFO CONFIGURATIONS |
| IDT72V261LA | 3.3 VOLT CMOS SuperSync FIFO |
| IDT72V85L15PAG | 3.3 Volt CMOS DUAL ASYNCHRONOUS FIFO |
| IDT72V85L15PAGI | 3.3 Volt CMOS DUAL ASYNCHRONOUS FIFO |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| IDT72T54252L6-7BB | 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
| IDT72T54252L6-7BBI | 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
| IDT72T54262L5BB | 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
| IDT72T54262L5BBG | 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:是 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
| IDT72T54262L6-7BB | 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
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