參數(shù)資料
型號: IDT82V3255TFG8
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 73/132頁
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描述: IC PLL WAN SMC STRATUM 3 64-TQFP
標(biāo)準(zhǔn)包裝: 1,250
類型: 時鐘/頻率發(fā)生器,多路復(fù)用器
PLL:
主要目的: 以太網(wǎng),SONET/SDH,Stratum
輸入: CMOS,LVDS,PECL
輸出: CMOS,LVDS,PECL
電路數(shù): 1
比率 - 輸入:輸出: 3:3
差分 - 輸入:輸出: 是/是
頻率 - 最大: 622.08MHz
電源電壓: 3 V ~ 3.6 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 64-LQFP
供應(yīng)商設(shè)備封裝: 64-TQFP(10x10)
包裝: 帶卷 (TR)
其它名稱: 82V3255TFG8
IDT82V3255
WAN PLL
JTAG
45
December 3, 2008
5JTAG
This device is compliant with the IEEE 1149.1 Boundary Scan stan-
dard except the following:
The output boundary scan cells do not capture data from the
core and the device does not support EXTEST instruction;
The TRST pin is set low by default and JTAG is disabled in order
to be consistent with other manufacturers.
The JTAG interface timing diagram is shown in Figure 17.
Figure 17. JTAG Interface Timing Diagram
Table 33: JTAG Timing Characteristics
Symbol
Parameter
Min
Typ
Max
Unit
tTCK
TCK period
100
ns
tS
TMS / TDI to TCK setup time
25
ns
tH
TCK to TMS / TDI Hold Time
25
ns
tD
TCK to TDO delay time
50
ns
TCK
TDO
TMS
TDI
t
TCK
t
S
t
H
t
D
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