參數(shù)資料
型號: IDT82V3255TFG8
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 94/132頁
文件大小: 0K
描述: IC PLL WAN SMC STRATUM 3 64-TQFP
標準包裝: 1,250
類型: 時鐘/頻率發(fā)生器,多路復用器
PLL:
主要目的: 以太網,SONET/SDH,Stratum
輸入: CMOS,LVDS,PECL
輸出: CMOS,LVDS,PECL
電路數(shù): 1
比率 - 輸入:輸出: 3:3
差分 - 輸入:輸出: 是/是
頻率 - 最大: 622.08MHz
電源電壓: 3 V ~ 3.6 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 64-LQFP
供應商設備封裝: 64-TQFP(10x10)
包裝: 帶卷 (TR)
其它名稱: 82V3255TFG8
IDT82V3255
WAN PLL
Programming Information
64
December 3, 2008
IN1_IN2_DIFF_HF_DIV_CNFG - Differential Input Clock 1 & 2 High Frequency Divider Configuration
Address: 18H
Type: Read / Write
Default Value: 00XXXX00
Bit
Name
Description
7 - 6
IN2_DIFF_DIV[1:0]
These bits determine whether the HF Divider is used and what the division factor is for IN2_DIFF frequency division:
00: Bypassed. (default)
01: Divided by 4.
10: Divided by 5.
11: Reserved.
5 - 2
-
Reserved.
1 - 0
IN1_DIFF_DIV[1:0]
These bits determine whether the HF Divider is used and what the division factor is for IN1_DIFF frequency division:
00: Bypassed. (default)
01: Divided by 4.
10: Divided by 5.
11: Reserved.
76
54
321
0
IN2_DIFF_DIV1
IN2_DIFF_DIV0
-
IN1_DIFF_DIV1
IN1_DIFF_DIV0
相關PDF資料
PDF描述
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參數(shù)描述
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