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參數(shù)資料
| 型號(hào)： | IF180C52CXXX-20R |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 20 MHz, MICROCONTROLLER, PQFP44 |
| 文件頁數(shù)： | 103/344頁 |
| 文件大小： | 4745K |
| 代理商： | IF180C52CXXX-20R |
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191
AT90PWM216/316 [DATASHEET]
7710H–AVR–07/2013
17.10 USART Register Description
17.10.1
USART I/O Data Register – UDR
Bit 7:0 – RxB7:0: Receive Data Buffer (read access)
Bit 7:0 – TxB7:0: Transmit Data Buffer (write access)
The USART Transmit Data Buffer Register and USART Receive Data Buffer Registers share the same I/O address
referred to as USART Data Register or UDR. The Transmit Data Buffer Register (TXBn) will be the destination for
data written to the UDR Register location. Reading the UDR Register location will return the contents of the
Receive Data Buffer Register (RXBn).
For 5-, 6-, or 7-bit characters the upper unused bits will be ignored by the Transmitter and set to zero by the
Receiver.
The transmit buffer can only be written when the UDRE flag in the UCSRA Register is set. Data written to UDR
when the UDRE flag is not set, will be ignored by the USART Transmitter. When data is written to the transmit buf-
fer, and the Transmitter is enabled, the Transmitter will load the data into the Transmit Shift Register when the Shift
Register is empty. Then the data will be serially transmitted on the TxDn pin.
The receive buffer consists of a two level FIFO. The FIFO will change its state whenever the receive buffer is
accessed.
This register is available in both USART and EUSART modes.
17.10.2
USART Control and Status Register A – UCSRA
Bit 7 – RXC: USART Receive Complete
This flag bit is set when there are unread data in the receive buffer and cleared when the receive buffer is empty
(i.e., does not contain any unread data). If the Receiver is disabled, the receive buffer will be flushed and conse-
quently the RXC bit will become zero. The RXC flag can be used to generate a Receive Complete interrupt (see
description of the RXCIE bit).
This bit is available in both USART and EUSART modes.
Bit 6 – TXC: USART Transmit Complete
This flag bit is set when the entire frame in the Transmit Shift Register has been shifted out and there are no new
data currently present in the transmit buffer (UDR). The TXC flag bit is automatically cleared when a transmit com-
plete interrupt is executed, or it can be cleared by writing a one to its bit location. The TXC flag can generate a
Transmit Complete interrupt (see description of the TXCIE bit).
This bit is available in both USART and EUSART modes.
Bit
7
6
5
43
21
0
RXB[7:0]
UDR (Read)
TXB[7:0]
UDR (Write)
Read/Write
R/W
Initial Value
0
Bit
76543210
RXC
TXC
UDRE
FE
DOR
UPE
U2X
MPCM
UCSRA
Read/Write
R
R/W
RRRR
R/W
Initial Value
00100000
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IF180C52CXXX-20R | 8-BIT, MROM, 20 MHz, MICROCONTROLLER, PQFP44 |
| IS80C52CXXX-36:R | 8-BIT, MROM, 36 MHz, MICROCONTROLLER, PQCC44 |
| MR83C154TXXX-12/883R | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CQCC44 |
| MD80C52XXX-12SBD | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CDIP40 |
| MR80C52TXXX-12SBR | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CQCC44 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| IF180C52-L16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| IF180C52T-12 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| IF180C52T-16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| IF180C52T-20 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| IF180C52T-25 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
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