參數(shù)資料
型號： ISP1561BM,557
廠商： NXP SEMICONDUCTORS
元件分類： 總線控制器
英文描述： UNIVERSAL SERIAL BUS CONTROLLER, PQFP128
封裝： 14 X 14 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-420-1, LQFP-128
文件頁數(shù)： 94/103頁
文件大小： 457K
代理商： ISP1561BM,557
ISP1561_2
NXP B.V. 2007. All rights reserved.
Product data sheet
Rev. 02 — 5 March 2007
90 of 103
NXP Semiconductors
ISP1561
HS USB PCI Host Controller
16.1 Timing
[1]
REQ# and GNT# are point-to-point signals. GNT# has a setup of 10 ns; REQ# has a setup of 12 ns. All others are bus signals.
Table 135. PCI clock and IO timing
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
PCI clock timing; see Figure 5
Tcyc
CLK cycle time
30
-
32
ns
thigh
CLK HIGH time
11
-
ns
tlow
CLK LOW time
11
-
ns
SRCLK
CLK slew rate
1
-
4
V/ns
SRRST#
RST# slew rate
50
-
mV/ns
PCI input timing; see Figure 6
tsu
input set-up time to CLK - bused signals
7
-
ns
tsu(ptp)
input set-up time to CLK - point-to-point
--ns
th
input hold time from CLK
0
-
ns
PCI output timing; see Figure 7
tval
CLK to signal valid delay time - bused signals
2
-
11
ns
tval(ptp)
CLK to signal valid delay time - point-to-point
-
12
ns
ton
oat to active delay time
2
-
ns
toff
active to oat delay time
-
28
ns
PCI reset timing
trst-clk
reset active time after CLK stable
100
-
s
trst
reset active time after power stable
1
-
ms
Fig 5.
PCI clock
minimum value
0.4VDD
Tcyc
mbl341
tHIGH
tLOW
0.6VDD
0.5VDD
0.4VDD
0.3VDD
0.2VDD
相關PDF資料
PDF描述
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參數(shù)描述
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ISP1562BE 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Hi-Speed USB PCI host controller
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