參數(shù)資料
型號： M38049FFLWG
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 16.8 MHz, MICROCONTROLLER, PBGA64
封裝： 6 X 6 MM, 0.65 MM PITCH, PLASTIC, LGA-64
文件頁數(shù)： 28/131頁
文件大?。?/td> 1740K
代理商： M38049FFLWG
Rev.1.00
Oct 27, 2008
Page 121 of 128
REJ03B0266-0100
3804 Group (Spec.L)
Timing requirements and switching characteristics
Table 31
Timing requirements (1)
(VCC = 2.7 to 5.5 V, VSS = 0V, Ta = –20 to 85 °C, unless otherwise noted)
Symbol
Parameter
Limits
Unit
Min.
Typ.
Max.
tW(RESET)
Reset input “L” pulse width
td(P-R)ms + 16
XIN cycle
tC(XIN)
Main clock XIN
input cycle time
4.5
≤ VCC ≤ 5.5 V
59.5
ns
4.0
≤ VCC < 4.5 V
10000/(86 VCC
219)
2.7
≤ VCC < 4.0 V
26
× 103/(82 VCC 3)
tWH(XIN)
Main clock XIN
input “H” pulse width
4.5
≤ VCC ≤ 5.5 V
25
ns
4.0
≤ VCC < 4.5 V
4000/(86 VCC
219)
2.7
≤ VCC < 4.0 V
10000/(82 VCC
3)
tWL(XIN)
Main clock XIN
input “L” pulse width
4.5
≤ VCC ≤ 5.5 V
25
ns
4.0
≤ VCC < 4.5 V
4000/(86 VCC
219)
2.7
≤ VCC < 4.0 V
10000/(82 VCC
3)
tC(XCIN)
Sub-clock XCIN input cycle time
20
μs
tWH(XCIN)
Sub-clock XCIN input “H” pulse width
5
μs
tWL(XCIN)
Sub-clock XCIN input “L” pulse width
5
μs
tC(CNTR)
CNTR0
CNTR2
input cycle time
4.5
≤ VCC ≤ 5.5 V
120
ns
4.0
≤ VCC < 4.5 V
160
2.7
≤ VCC < 4.0 V
250
tWH(CNTR)
CNTR0
CNTR2
input “H” pulse width
4.5
≤ VCC ≤ 5.5 V
48
ns
4.0
≤ VCC < 4.5 V
64
2.7
≤ VCC < 4.0 V
115
tWL(CNTR)
CNTR0
CNTR2
input “L” pulse width
4.5
≤ VCC ≤ 5.5 V
48
ns
4.0
≤ VCC < 4.5 V
64
2.7
≤ VCC < 4.0 V
115
tWH(INT)
INT00, INT01, INT1, INT2,
INT3, INT40, INT41
input “H” pulse width
4.5
≤ VCC ≤ 5.5 V
48
ns
4.0
≤ VCC < 4.5 V
64
2.7
≤ VCC < 4.0 V
115
tWL(INT)
INT00, INT01, INT1, INT2,
INT3, INT40, INT41
input “L” pulse width
4.5
≤ VCC ≤ 5.5 V
48
ns
4.0
≤ VCC < 4.5 V
64
2.7
≤ VCC < 4.0 V
115
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