參數(shù)資料
型號(hào)： MB81V17805A-70L
廠商： Fujitsu Limited
英文描述： CMOS 2M ×8 BIT Hyper Page Mode Dynamic RAM(CMOS 2M ×8 位超級(jí)頁(yè)面存取模式動(dòng)態(tài)RAM)
中文描述： 的CMOS 200萬(wàn)× 8位超頁(yè)模式動(dòng)態(tài)RAM的CMOS（200萬(wàn)× 8位超級(jí)頁(yè)面存取模式動(dòng)態(tài)內(nèi)存）
文件頁(yè)數(shù)： 23/30頁(yè)
文件大?。?/td> 604K
代理商： MB81V17805A-70L
23
MB81V17805A-60/-60L/-70/-70L
t
CWL
VALID
DATA
VALID
DATA
COL
ADD
ROW
ADD
COL
ADD
Fig. 15 – HYPER PAGE MODE READ-MODIFY-WRITE CYCLE
HIGH-Z
DESCRIPTION
During the hyper page mode of operation, the read-modify-write cycle can be executed by switching WE from High to Low after
input data appears at the DQ pins during a normal cycle.
t
RASP
t
RP
t
CRP
t
RCD
t
CWD
t
RWL
t
HPRWC
t
CWD
t
CP
t
ASC
t
CAH
t
ASC
t
CAH
t
RAD
t
RAH
t
ASR
t
RCS
t
AWD
t
CWL
t
RCS
t
WP
t
WP
t
DS
t
DH
t
DH
t
DS
t
RWD
t
DZC
t
OED
t
CAC
t
AA
t
ON
t
ON
t
AA
t
CAC
t
OED
t
ON
t
ON
t
RAC
t
DZO
t
OEA
t
CPA
t
OEH
t
OEZ
t
OEA
t
OEH
t
OEZ
RAS
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
V
OH
V
OL
CAS
WE
DQ
(Output)
A
0
to A
10
V
IH
V
IL
DQ
(Input)
V
IH
V
IL
OE
“H” or “L” level (excluding Address and DQ)
“H” or “L” level, “H”
→
“L” or “L”
→
“H” transition (Address and DQ)
Valid Data
t
CPWD
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PDF描述
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MB81V17805B-60 2M ×8 BIT Hyper Page Mode Dynamic RAM(CMOS 2M ×8位超級(jí)頁(yè)面存取模式動(dòng)態(tài)RAM)
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MB81V18160A-70L CMOS 1M ×16 BIT Fast Page Mode Dynamic RAM(CMOS 1M ×16 位快速頁(yè)面存取模式動(dòng)態(tài)RAM)
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參數(shù)描述
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MB82101BBN 制造商:MURATA 制造商全稱:Murata Manufacturing Co., Ltd. 功能描述:HIGH FREQUENCY CERAMIC CAPACITORS
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