參數(shù)資料
型號： MC3S12XEP100F1CAGR
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP144
封裝： LQFP-144
文件頁數(shù)： 568/1324頁
文件大?。?/td> 8453K
代理商： MC3S12XEP100F1CAGR
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Chapter 8 S12X Debug (S12XDBGV3) Module
MC9S12XE-Family Reference Manual Rev. 1.21
Freescale Semiconductor
317
Because of an order from the United States International Trade Commission, BGA-packaged product lines and partnumbers
indicated here currently are not available from Freescale for import or sale in the United States prior to September 2010
The trigger priorities described in Table 8-42 dictate that in the case of simultaneous matches, the match
on the lower channel number (0,1,2,3) has priority. The SC[3:0] encoding ensures that a match leading to
nal state has priority over all other matches.
8.3.2.7.3
Debug State Control Register 3 (DBGSCR3)
Read: If COMRV[1:0] = 10
Write: If COMRV[1:0] = 10 and S12XDBG is not armed.
This register is visible at 0x0027 only with COMRV[1:0] = 10. The state control register three selects the
targeted next state whilst in State3. The matches refer to the match channels of the comparator match
control logic as depicted in Figure 8-1 and described in Section 8.3.2.8.1”. Comparators must be enabled
by setting the comparator enable bit in the associated DBGXCTL control register.
0010
Any match triggers to Final State
0011
Match3 triggers to State1....... Other matches have no effect
0100
Match3 triggers to State3....... Other matches have no effect
0101
Match3 triggers to Final State....... Other matches have no effect
0110
Match0 triggers to State1....... Match1 triggers to State3....... Other matches have no effect
0111
Match1 triggers to State3....... Match0 triggers Final State....... Other matches have no effect
1000
Match0 triggers to State1....... Match2 triggers to State3....... Other matches have no effect
1001
Match2 triggers to State3....... Match0 triggers Final State....... Other matches have no effect
1010
Match1 triggers to State1....... Match3 triggers to State3....... Other matches have no effect
1011
Match3 triggers to State3....... Match1 triggers Final State....... Other matches have no effect
1100
Match2 triggers to State1..... Match3 trigger to Final State
1101
Match2 has no affect, all other matches (M0,M1,M3) trigger to Final State
1110
Reserved. (No match triggers state sequencer transition)
1111
Reserved. (No match triggers state sequencer transition)
Address: 0x0027
76543210
R
0000
SC3
SC2
SC1
SC0
W
Reset
0
00000
= Unimplemented or Reserved
Figure 8-11. Debug State Control Register 3 (DBGSCR3)
Table 8-26. DBGSCR3 Field Descriptions
Field
Description
3–0
SC[3:0]
These bits select the targeted next state whilst in State3, based upon the match event.
Table 8-25. State2 —Sequencer Next State Selection (continued)
SC[3:0]
Description
相關(guān)PDF資料
PDF描述
MC9S12XEP100F1VAL 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP112
MC3S12XEP100F1CAL 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP112
MC9S12XEP100F1CALR 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP112
MC9S12XEP100F1VAAR 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP80
MC9S12XEP100J1CAA 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP80
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MC3S12XEP100F1CALR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers
MC3S12XEP100F1CVLR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers
MC3S12XEP100F1MAAR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers
MC3S12XEP100F1MAGR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers
MC3S12XEP100F1MALR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers
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